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參數資料
| 型號： | EP4CGX50CF23C7N |
| 廠商： | Altera |
| 文件頁數： | 11/42頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC CYCLONE IV FPGA 50K 484-FBGA |
| 產品培訓模塊： | Cyclone IV FPGA Family Overview |
| 特色產品： | Cyclone? IV FPGAs |
| 標準包裝： | 60 |
| 系列： | CYCLONE® IV GX |
| LAB/CLB數： | 3118 |
| 邏輯元件/單元數： | 49888 |
| RAM 位總計： | 2562048 |
| 輸入/輸出數： | 290 |
| 電源電壓： | 1.16 V ~ 1.24 V |
| 安裝類型： | 表面貼裝 |
| 工作溫度： | 0°C ~ 85°C |
| 封裝/外殼： | 484-BGA |
| 供應商設備封裝： | 484-FBGA（23x23） |
| 其它名稱： | 544-2731 |
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Chapter 1: Cyclone IV Device Datasheet
1–19
Switching Characteristics
December 2013
Altera Corporation
Signal detect/loss
threshold
PIPE mode
65
—
175
65
—
175
65
—
175
mV
tLTR (10)
—
75
—
75——
75
s
tLTR-LTD_Manual (11)
—
15—
—
15
—
—15—
—
s
tLTD (12)
—
0
100
4000
0
100
4000
0
100
4000
ns
tLTD_Manual (13)
—
4000
—
4000
—
4000
ns
tLTD_Auto (14)
—
4000
—
4000
—
4000
ns
Receiver buffer and
CDR offset
cancellation time
(per channel)
—
17000
—
17000
—
17000
recon
fig_c
lk
cycles
Programmable DC
gain
DC Gain Setting =
0
—0
—
0
—
0
—
dB
DC Gain Setting =
1
—3
—
3
—
3
—
dB
DC Gain Setting =
2
—6
—
6
—
6
—
dB
Transmitter
Supported I/O
Standards
1.5 V PCML
Data rate (F324 and
smaller package)
—
600
—
2500
600
—
2500
600
—
2500
Mbps
Data rate (F484 and
larger package)
—
600
—
3125
600
—
3125
600
—
2500
Mbps
VOCM
0.65 V setting
—
650
—
650
—
650
—
mV
Differential on-chip
termination resistors
100
setting
—
100
—
100
—
100
—
150
setting
—
150
—
150
—
150
—
Differential and
common mode
return loss
PIPE, CPRI LV,
Serial Rapid I/O
SR, SDI, XAUI,
SATA
Compliant
—
Rise time
—
50
—
200
50
—
200
50
—
200
ps
Fall time
—
50
—
200
50
—
200
50
—
200
ps
Intra-differential pair
skew
—
15
—
15
—
15
ps
Intra-transceiver
block skew
—
120
—
120
—
120
ps
Table 1–21. Transceiver Specification for Cyclone IV GX Devices (Part 3 of 4)
Symbol/
Description
Conditions
C6
C7, I7
C8
Unit
Min
Typ
Max
Min
Typ
Max
Min
Typ
Max
相關PDF資料 |
PDF描述 |
|---|---|
| HMC36DRES-S93 | CONN EDGECARD 72POS .100 EYELET |
| ES1B | DIODE FAST 1A 100V SMA |
| VE-2TN-CW-F1 | CONVERTER MOD DC/DC 18.5V 100W |
| GBM24DSEN | CONN EDGECARD 48POS .156 EYELET |
| HCC49DRYS-S734 | CONN EDGECARD 98POS DIP .100 SLD |
相關代理商/技術參數 |
參數描述 |
|---|---|
| EP4CGX50CF23C8 | 功能描述:FPGA - 現場可編程門陣列 FPGA - Cyclone IV GX 3118 LABs 290 IOs RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數量: 邏輯塊數量:943 內嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風格:SMD/SMT 封裝 / 箱體:FBGA-256 |
| EP4CGX50CF23C8N | 功能描述:FPGA - 現場可編程門陣列 FPGA - Cyclone IV GX 3118 LABs 290 IOs RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數量: 邏輯塊數量:943 內嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風格:SMD/SMT 封裝 / 箱體:FBGA-256 |
| EP4CGX50CF23I7 | 功能描述:FPGA - 現場可編程門陣列 FPGA - Cyclone IV GX 3118 LABs 290 IOs RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數量: 邏輯塊數量:943 內嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風格:SMD/SMT 封裝 / 箱體:FBGA-256 |
| EP4CGX50CF23I7N | 功能描述:FPGA - 現場可編程門陣列 FPGA - Cyclone IV GX 3118 LABs 290 IOs RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數量: 邏輯塊數量:943 內嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風格:SMD/SMT 封裝 / 箱體:FBGA-256 |
| EP4CGX50DF27C6 | 功能描述:FPGA - 現場可編程門陣列 FPGA - Cyclone IV GX 3118 LABs 310 IOs RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數量: 邏輯塊數量:943 內嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風格:SMD/SMT 封裝 / 箱體:FBGA-256 |
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