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參數(shù)資料
| 型號： | MC68302FC20 |
| 廠商： | MOTOROLA INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | Integrated Multiprotocol Processor User’s Manual |
| 中文描述： | RISC PROCESSOR, PQFP132 |
| 封裝： | PLASTIC, QFP-132 |
| 文件頁數(shù)： | 96/480頁 |
| 文件大小： | 1815K |
| 代理商： | MC68302FC20 |
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System Integration Block (SIB)
3-46
MC68302 USER’S MANUAL
MOTOROLA
address match exists within its address space and, therefore, whether to assert the chip-
select line.
111 = Not supported; reserved. Chip select will not assert if this value is chosen.
110 = Value may be used.
000 = Value may be used.
After system reset, the FC field in BR3–BR0 defaults to supervisor program space (FC =
110) to select a ROM device containing the reset vector. Because of the priority mechanism
and the EN bit, only the CS0 line is active after a system reset.
NOTE
The FC bits can be masked and ignored by the chip-select logic
using CFC in the OR.
Bits 12–2—Base Address
These bits are used to set the starting address of a particular address space. The address
compare logic uses only A23–A13 to cause an address match within its block size. The
base address should be located on a block boundary. For example, if the block size is 64k
bytes, then the base address should be a multiple of 64k.
After system reset, the base address defaults to zero to select a ROM device on which
the reset vector resides. All base address values default to zero on system reset, but, be-
cause of the priority mechanism, only CS0 will be active.
NOTE
All address bits can be masked and ignored by the chip-select
logic through the base address mask in the OR.
RW—Read/Write
0 = The chip-select line is asserted for read operations only.
1 = The chip-select line is asserted for write operations only.
After system reset, this bit defaults to zero (read-only operation).
NOTE
This bit can be masked and ignored by the read-write compare
logic, as determined by MRW in the OR. The line is then assert-
ed for both read and write cycles.
On write protect violation cycles (RW = 0 and MRW = 1), BERR will be generated if WPVE
is set, and WPV will be set.
If the write protect mechanism is used by an external master, the R/W low to AS asserted
timing should be 16 ns minimum.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| MC68302FC25 | Integrated Multiprotocol Processor User’s Manual |
| MC68302 | Integrated Multiprotocol Processor User’s Manual |
| MC68302PV16 | Integrated Multiprotocol Processor User’s Manual |
| MC68302CFC16 | Integrated Multiprotocol Processor User’s Manual |
| MC68302CFC20 | Integrated Multiprotocol Processor User’s Manual |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| MC68302FC20C | 功能描述:IC MPU MULTI-PROTOCOL 132-PQFP RoHS:否 類別:集成電路 (IC) >> 嵌入式 - 微處理器 系列:M683xx 標(biāo)準(zhǔn)包裝:2 系列:MPC8xx 處理器類型:32-位 MPC8xx PowerQUICC 特點:- 速度:133MHz 電壓:3.3V 安裝類型:表面貼裝 封裝/外殼:357-BBGA 供應(yīng)商設(shè)備封裝:357-PBGA（25x25） 包裝:托盤 |
| MC68302FC25 | 制造商:MOTOROLA 制造商全稱:Motorola, Inc 功能描述:Integrated Multiprotocol Processor User’s Manual |
| MC68302FC25C | 功能描述:IC MPU MULTI-PROTOCOL 132-PQFP RoHS:否 類別:集成電路 (IC) >> 嵌入式 - 微處理器 系列:M683xx 標(biāo)準(zhǔn)包裝:2 系列:MPC8xx 處理器類型:32-位 MPC8xx PowerQUICC 特點:- 速度:133MHz 電壓:3.3V 安裝類型:表面貼裝 封裝/外殼:357-BBGA 供應(yīng)商設(shè)備封裝:357-PBGA（25x25） 包裝:托盤 |
| MC68302FE16 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Communications Controller |
| MC68302FE16C | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Communications Controller |
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