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參數資料
| 型號： | MC68HC05B6 |
| 廠商： | Motorola, Inc. |
| 英文描述： | 8-Bit Microcontroller Units (MCU).(8位微控制器) |
| 中文描述： | 8位微控制器單元（MCU）。（8位微控制器） |
| 文件頁數： | 51/298頁 |
| 文件大?。?/td> | 3532K |
| 代理商： | MC68HC05B6 |
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MC68HC05B6
Rev. 4
MOTOROLA
3-9
MEMORY AND REGISTERS
3
3.8
Miscellaneous register
POR — Power-on reset bit (see Section 9.1)
This bit is set each time the device is powered on. Therefore, the state of the POR bit allows the
user to make a software distinction between a power-on and an external reset. This bit cannot be
set by software and is cleared by writing it to zero.
1 (set)
–
A power-on reset has occurred.
0 (clear) –
No power-on reset has occurred.
INTP, INTN — External interrupt sensitivity options (see Section 9.2)
These two bits allow the user to select which edge the IRQ pin will be sensitive to (see Table 3-3).
Both bits can be written to only while the I-bit is set, and are cleared by power-on or external reset,
thus the device is initialised with negative edge and low level sensitivity.
INTE — External interrupt enable (see Section 9.2)
1 (set)
–
External interrupt function (IRQ) enabled.
0 (clear) –
External interrupt function (IRQ) disabled.
The INTE bit can be written to only while the I-bit is set, and is set by power-on or external reset,
thus enabling the external interrupt function.
(1) The POR bit is set each time there is a power-on reset.
(2) The state of the WDOG bit after reset is dependent on the mask option selected; 1=watchdog enabled, 0=watchdog disabled.
Address
bit 7
bit 6
bit 5
bit 4
bit 3
bit 2
bit 1
bit 0
State
on reset
(2)
001 000
Mscellaneous
$000C POR
(1)
INTP
INTN
INTE
SFA
SFB
SM WDOG
Table 3-3
IRQ sensitivity
INTP
0
0
1
1
INTN
0
1
0
1
IRQ sensitivity
Negative edge and low level sensitive
Negative edge only
Positive edge only
Positive and negative edge sensitive
TPG
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PDF描述 |
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參數描述 |
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| MC68HC05BD5 | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:High-density complementary metal oxide semiconductor (HCMOS) microcontroller unit |
| MC68HC05C0CP | 制造商:Motorola Inc 功能描述: |
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