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參數(shù)資料
| 型號： | MC68HRC08JK1 |
| 廠商： | Motorola, Inc. |
| 英文描述： | HCMOS Microcontroller Unit |
| 中文描述： | HCMOS微控制器 |
| 文件頁數(shù)： | 151/198頁 |
| 文件大小： | 2403K |
| 代理商： | MC68HRC08JK1 |
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External Interrupt (IRQ)
Functional Description
MC68H(R)C08JL3
—
Rev. 4
Technical Data
MOTOROLA
External Interrupt (IRQ)
For More Information On This Product,
Go to: www.freescale.com
151
NOTE:
The interrupt mask (I) in the condition code register (CCR) masks all
interrupt requests, including external interrupt requests.
(See
7.6
Exception Control
.)
Figure 13-1. IRQ Module Block Diagram
13.4.1 IRQ1 Pin
A logic zero on the IRQ1 pin can latch an interrupt request into the IRQ1
latch. A vector fetch, software clear, or reset clears the IRQ1 latch.
If the MODE1 bit is set, the IRQ1 pin is both falling-edge-sensitive and
low-level-sensitive. With MODE1 set, both of the following actions must
occur to clear IRQ1:
ACK1
RESET
IMASK1
D
Q
CK
CLR
IRQ1
INTERRUPT
REQUEST
HIGH
VOLTAGE
DETECT
TO MODE
SELECT
LOGIC
IRQ1
FF
V
DD
MODE1
SYNCHRO-
NIZER
IRQF1
TO CPU FOR
BIL/BIH
INSTRUCTIONS
VECTOR
FETCH
DECODER
I
V
DD
I
NTERNAL
PULLUP
DEVICE
IRQ1
IRQPUD
Addr.
Register Name
Bit 7
6
5
4
3
2
1
Bit 0
$001D
IRQ Status and Control
Register
(INTSCR)
Read:
0
0
0
0
IRQF1
0
IMASK1
MODE1
Write:
ACK1
Reset:
0
0
0
0
0
0
0
0
= Unimplemented
Figure 13-2. IRQ I/O Register Summary
F
Freescale Semiconductor, Inc.
n
.
相關PDF資料 |
PDF描述 |
|---|---|
| MC68HRC08JK3 | HCMOS Microcontroller Unit |
| MC68HRC08JL3 | HCMOS Microcontroller Unit |
| MC68H(R)C08JK3 | HCMOS Microcontroller Unit |
| MC68H(R)C08JL3 | HCMOS Microcontroller Unit |
| MC68HC001 | 2.048V 100ppm/Degrees C, 50uA in SOT23-3 Series (Bandgap) Voltage Reference 3-SOT-23 -40 to 125 |
相關代理商/技術參數(shù) |
參數(shù)描述 |
|---|---|
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