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參數資料
| 型號： | MC88LV915T |
| 廠商： | Motorola, Inc. |
| 英文描述： | LOW SKEW CMOS PLL CLOCK DRIVER |
| 中文描述： | 低偏移的CMOS PLL時鐘驅動器 |
| 文件頁數： | 6/11頁 |
| 文件大小： | 127K |
| 代理商： | MC88LV915T |
MC88LV915T
MOTOROLA
TIMING SOLUTIONS
BR1333 — Rev 6
6
Applications Information for All Versions
Q/2 OUTPUT
tCYCLE SYNC INPUT
The MC88LV915T aligns rising edges of the FEEDBACK input and SYNC input, therefore the SYNC input
does not require a 50% duty cycle.
All skew specs are measured between the VCC/2 crossing point of the appropriate output edges.All skews
are specified as ‘windows’, not as a
±
deviation around a center point.
If a “Q” output is connected to the FEEDBACK input (this situation is not shown), the “Q” output frequency
would match the SYNC input frequency, the 2X_Q output would run at twice the SYNC frequency, and the
Q/2 output would run at half the SYNC frequency.
Timing Notes:
(These waveforms represent the hook–up configuration of Figure 2a on page 7)
FEEDBACK
INPUT
SYNC INPUT
(SYNC[1] or
SYNC[0])
Figure 1. Output/Input Switching Waveforms and Timing Diagrams
tCYCLE “Q” OUTPUTS
2X_Q OUTPUT
Q5 OUTPUT
tSKEWf
tSKEWf
tSKEWR
tSKEWr
tSKEWALL
Q0 – Q4
OUTPUTS
PD
t
相關PDF資料 |
PDF描述 |
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相關代理商/技術參數 |
參數描述 |
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