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參數(shù)資料
| 型號： | TSPC750AMGSU8LH |
| 元件分類： | 微處理器 |
| 英文描述： | Microprocessor |
| 中文描述： | 微處理器 |
| 文件頁數(shù)： | 25/44頁 |
| 文件大小： | 870K |
| 代理商： | TSPC750AMGSU8LH |
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25
TSPC750A/740A
2128A–HIREL–01/02
L2ClockACSpecifications
Notes:
1. L2CLKoutputsareL2CLK_OUTA,L2CLK_OUTBandL2SYNC_OUTpins.TheL2cacheinterfacesupportshigherfrequen-
cieswhenappropriateloadconditionshavebeenconsidered.TheL2I/Odrivershavebeendesignedtosupporta133MHz
L2busloadedwith4off-the-shelfpipelinedsynchronousburstSRAMs.RunningtheL2busbeyond133MHzrequirestightly
coupledcustomizedSRAMsoramulti-chipmodule(MCM)implementation.TheL2CLKfrequencytocorefrequencyset-
tingsmustbechosensuchthattheresultingL2CLKfrequencyandcorefrequencydonotexceedtheirrespectivemaximum
orminimumoperatingfrequencies.L2CLK_OUTAandL2CLK_OUTBmusthaveequalloading.
2. ThenominaldutycycleoftheL2CLKis50%measuredatmidpointvoltage.
3. Thetotalinputjitter(shorttermandlongtermcombined)mustbeunder
±
150ps.
4. TheDLLre-locktimeisspecifiedintermsofL2CLKs.ThenumberinthetablemustbemultipliedbytheperiodofL2CLKto
computetheactualtimedurationinnanoseconds.Re-locktimingisguaranteedbydesignandcharacterization.
5. TheL2CR[L2SL]bitshouldbesetforL2CLKfrequencieslessthan110MHz.
Table12.
L2CLKOutputACTimingSpecifications
V
DD
=AV
DD
=L2AV
DD
=2.6V
DC
±
100mV,OV
DD
=L2OV
DD
=3.3±
5%V
DC
,GND=0V
DC
,
-55
≤
T
j
<125
°
C
Num
Characteristic
Min
Max
Unit
Notes
L2CLKFrequency
80
133
MHz
1,5
22
L2CLKCycleTime
7.5
12.5
ns
23
L2CLKDutyCycle
50
%
2
L2CLKJitter
±
150
ps
3
InternalDLL-relockTime
640
-
L2CLK
4
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| TSPC750AMGU10LE | Microprocessor |
| TSPC750AMGU10LH | Microprocessor |
| TSPC750AMGU12LE | Microprocessor |
| TSPC750AVGS10LE | Microprocessor |
| TSPC750AVGS10LH | Microprocessor |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
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