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參數資料
| 型號： | TSXPC750AVG12LE |
| 英文描述： | Microprocessor |
| 中文描述： | 微處理器 |
| 文件頁數： | 24/44頁 |
| 文件大?。?/td> | 870K |
| 代理商： | TSXPC750AVG12LE |
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24
TSPC750A/740A
2128A–HIREL–01/02
Notes:
1. Alloutputspecificationsaremeasuredfromthe1.4VoftherisingedgeofSYSCLKtoTTLlevel(0.8 Vor2.0 V)ofthesignal
inquestion.Bothinputandoutputtimingaremeasuredatthepin.
2. AllmaximumtimingspecificationsassumeC
L
=50pF.
3. ThisminimumparameterassumesC
L
=0pF.
4. t
sysclk
istheperiodoftheexternalbusclock(SYSCLK)innanoseconds(ns).Thenumbersgiveninthetablemustbemulti-
pliedbytheperiodofSYSCLKtocomputetheactualtimedurationoftheparameterinquestion.
5. OutputsignaltransitionsfromGNDto2.0VorOV
DD
to0.8V.
6. NominalprechargewidthforABBandDBBis0.5t
sysclk
.
7. NominalprechargewidthforARTRYis1.0t
sysclk
.
8. Guaranteedbydesignandcharacterization.
Figure13.
OutputTimingDiagram
19
SYSCLKtoARTRYPrechargeEnable
0.2*t
sysclk
+1.0
-
ns
3,4,7
20
MaximumDelaytoARTRYPrecharge
-
1
t
sysclk
4,7
21
SYSCLKtoARTRYHighImpedanceAfterPrecharge
-
2
t
sysclk
4,7,8
Table11.
60xBusOutputACTimingSpecifications(Continued)
(1)
V
DD
=AV
DD
=L2AV
DD
=2.6V
DC
±
100mV,OV
DD
=L2OV
DD
=3.3±5%V
DC
,GND=0V
DC
,-55
≤
T
j
<125
°
C,CL=50pF(2)
Num
Characteristic
200,233,266MHz
Unit
Notes
Min
Max
SYSCLK
12
15
16
16
ALL OUTPUTS
(Except TS, ABB,
ARTRY, DBB)
TS
ARTRY
ABB, DBB
VM
VM
VM = Midpoint Voltage (1.4V)
15
VM
18
14
13
13
17
21
19
20
相關PDF資料 |
PDF描述 |
|---|---|
| TSXPC750AVG12LH | Microprocessor |
| TSXPC750AVG8LE | Microprocessor |
| TSXPC750AVG8LH | Microprocessor |
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| TSXPC750AVGSU10LH | Microprocessor |
相關代理商/技術參數 |
參數描述 |
|---|---|
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