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參數資料
型號: MC68302RC16
廠商: MOTOROLA INC
元件分類: 微控制器/微處理器
英文描述: Integrated Multiprotocol Processor User’s Manual
中文描述: RISC PROCESSOR, CPGA132
封裝: PGA-132
文件頁數: 430/480頁
文件大小: 1815K
代理商: MC68302RC16
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SCC Programming Reference
E-8
MC68360 USER’S MANUAL
MOTOROLA
E.1.1.2.3 SCC Data Synchronization Register (DSR).
set $886 (SCC1), $896 (SCC2), and $8A6 (SCC3). The DSR specifies the pattern used for
the frame synchronization procedure. For HDLC, the DSR should be set to $7E7E. The DSR
value after reset is $7E7E.
This 16-bit register is located at off-
E.1.1.2.4 HDLC Event Register (SCCE).
(SCC1), $898 (SCC2), and $8A8 (SCC3) on D15-D8 of a 16-bit data bus. The SCCE is used
to report events recognized by the HDLC channel. Bits mst be cleared by the user to avoid
missing interrupt events. Bits are cleared by writing ones to the corresponding bit positions
This 8-bit register is located at offset $888
.
CTS—Clear-To-Send Status Changed
0 = No interrupt.
1 = A change in the status of CTS was detected.
CD—Carrier Detect Status Changed
0 = No interrupt.
1 = A change in the status
of CD was detected.
IDL—IDLE Sequence Status Changed
0 = No interrupt.
1 = A change in the status of the receive data serial line was detected.
TXE—Tx Error
0 = No interrupt
1 = An error (CTS lost or underrun) occurred on the transmitter channel.
RXF—Rx Frame
0 = No interrupt.
1 = A complete frame has been received on the HDLC channel.
BSY—Busy Condition
0 = No interrupt.
1 = A frame was received and discarded due to lack of buffers.
TXB—Tx Buffer
0 = No interrupt.
1 = A buffer has been transmitted on the HDLC channel (set only if the I bit in the Tx
buffer descriptor is set).
15
8
7
0
SYN2
SYN1
7
6
5
4
3
2
1
0
CTS
CD
IDL
TXE
RXF
BSY
TXB
RXB
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