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參數資料
型號: MC68302RC20
廠商: MOTOROLA INC
元件分類: 微控制器/微處理器
英文描述: Integrated Multiprotocol Processor User’s Manual
中文描述: RISC PROCESSOR, CPGA132
封裝: PGA-132
文件頁數: 458/480頁
文件大小: 1815K
代理商: MC68302RC20
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SCC Programming Reference
E-36
MC68360 USER’S MANUAL
MOTOROLA
BIT 15—Reserved for future use; should be written with zero.
EXSYN—External Sync
When set, the SCC receiver uses the L1SY1/CD1, CD2, or CD3 pins to synchronize the
receiver and transmitter to the beginning of a transparent frame.
NTSYN—No Transmit SYNC
This bit must be set for the SCC to operate in the transparent mode.
REVD—Reverse Data
When this bit is set, the receiver and transmitter will reverse the character bit order, trans-
mitting the most significant bit first.
Bits 11-6—Reserved for future use; should be written with zero.
DIAG1, DIAG0—Diagnostic Mode
00 = Normal operation.
01 = Loopback mode.
10 = Automatic echo.
11 = Software operation.
ENR—Enable Receiver
0 = Receiver is disabled.
1 = Receiver is enabled
ENT—Enable Transmitter
0 = Transmitter is disabled.
1 = Transmitter is enabled.
MODE1, MODE0—Channel Mode
00 = HDLC.
01 = Asynchronous (UART and DDCMP).
10 = Synchronous DDCMP and V.110.
11 = BISYNC and Promiscuous (Transparent).
E.3.1.2.3 SCC Data Synchronization Register (DSR).
This 16-bit register is located at off-
set $886 (SCC1), $896 (SCC2), and $8A6 (SCC3). The DSR specifies the pattern used for
the receive frame synchronization procedure if the EXSYN bit is cleared. For transparent,
the DSR may be set to any desired pattern. The DSR value after reset is $7E7E.
E.3.1.2.4 Transparent Event Register (SCCE).
This 8-bit register is located at offset $888
(SCC1), $898 (SCC2), and $8A8 (SCC3) on D15-D8 of a 16-bit data bus. The SCCE is used
to report events recognized by the transparent channel. Bits must be cleared by the user to
avoid missing interrupt events. Bits are cleared by writing ones to the corresponding bit posi-
tions
15
8
7
0
SYN2
SYN1
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PDF描述
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參數描述
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