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參數資料
| 型號： | MC68302UM |
| 廠商： | Motorola, Inc. |
| 英文描述： | Integrated Multiprotocol Processor with PCMCIA |
| 中文描述： | 集成多協議處理器與PCMCIA |
| 文件頁數： | 151/480頁 |
| 文件大小： | 1815K |
| 代理商： | MC68302UM |
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Communications Processor (CP)
MOTOROLA
MC68302 USER’S MANUAL
4-31
tools are 1) the ready bit in the transmit buffer descriptor, 2) the
ENT bit, 3) the STOP TRANSMIT command, 4) the RESTART
TRANSMIT command, and 5) the FRZ bit in the SCM (UART
mode only).
ENR—Enable Receiver
When ENR is set, the receiver is enabled. When it is cleared, the receiver is disabled, and
any data in the receive FIFO is lost. If ENR is cleared during data reception, the receiver
aborts the current character. ENR may be set or cleared regardless of whether serial
clocks are present. To restart reception, the ENTER HUNT MODE command should be
issued before ENR is set again.
ENT—Enable Transmitter
When ENT is set, the transmitter is enabled; when ENT is cleared, the transmitter is dis-
abled. If ENT is cleared, the transmitter will abort any data transmission, clear the transmit
data FIFO and shift register, and force the TXD line high (idle). Data already in the trans-
mit shift register will not be transmitted. ENT may be set or cleared regardless of whether
serial clocks are present.
The STOP TRANSMIT command additionally aborts the current frame and would normal-
ly be given to the channel before clearing ENT. The command does not clear ENT auto-
matically. In a similar manner, to restart transmission, the user should issue the
RESTART TRANSMIT command and then set ENT. The command register is described
in 4.3 Command Set. The specific actions taken with each command vary somewhat ac-
cording to protocol and are discussed in each protocol section.
MODE1–MODE0—Channel Mode
00 = HDLC
01 = Asynchronous (UART and DDCMP)
10 = Synchronous DDCMP and V.110
11 = BISYNC and Promiscuous Transparent
4.5.4 SCC Data Synchronization Register (DSR)
Each DSR is a 16-bit, memory-mapped, read-write register. DSR specifies the pattern used
in the frame synchronization procedure of the SCC in the synchronous protocols. In the
UART protocol it is used to configure fractional stop bit transmission. After reset, the DSR
defaults to $7E7E (two FLAGs); thus, no additional programming is necessary for the HDLC
protocol. For BISYNC, DDCMP, and V.110, the contents of the DSR should be written be-
fore the channel is enabled. Note that for the DDCMP, SYN1 must equal SYN2 must equal
DSYN1 for proper operation.
NOTE
The DSR register has no relationship to the RS-232 signal “data
set ready,” which is also abbreviated DSR.
15
8
7
0
SYN2
SYN1
相關PDF資料 |
PDF描述 |
|---|---|
| MC68302FC16 | Integrated Multiprotocol Processor User’s Manual |
| MC68302FC20 | Integrated Multiprotocol Processor User’s Manual |
| MC68302FC25 | Integrated Multiprotocol Processor User’s Manual |
| MC68302 | Integrated Multiprotocol Processor User’s Manual |
| MC68302PV16 | Integrated Multiprotocol Processor User’s Manual |
相關代理商/技術參數 |
參數描述 |
|---|---|
| MC68306AG16B | 功能描述:微處理器 - MPU INTEGRATED EC000 MPU RoHS:否 制造商:Atmel 處理器系列:SAMA5D31 核心:ARM Cortex A5 數據總線寬度:32 bit 最大時鐘頻率:536 MHz 程序存儲器大小:32 KB 數據 RAM 大小:128 KB 接口類型:CAN, Ethernet, LIN, SPI,TWI, UART, USB 工作電源電壓:1.8 V to 3.3 V 最大工作溫度:+ 85 C 安裝風格:SMD/SMT 封裝 / 箱體:FBGA-324 |
| MC68306AG20B | 功能描述:微處理器 - MPU INTEGRATED EC000 MPU RoHS:否 制造商:Atmel 處理器系列:SAMA5D31 核心:ARM Cortex A5 數據總線寬度:32 bit 最大時鐘頻率:536 MHz 程序存儲器大小:32 KB 數據 RAM 大小:128 KB 接口類型:CAN, Ethernet, LIN, SPI,TWI, UART, USB 工作電源電壓:1.8 V to 3.3 V 最大工作溫度:+ 85 C 安裝風格:SMD/SMT 封裝 / 箱體:FBGA-324 |
| MC68306CEH16B | 功能描述:微處理器 - MPU INTEGRATED EC000 MPU RoHS:否 制造商:Atmel 處理器系列:SAMA5D31 核心:ARM Cortex A5 數據總線寬度:32 bit 最大時鐘頻率:536 MHz 程序存儲器大小:32 KB 數據 RAM 大小:128 KB 接口類型:CAN, Ethernet, LIN, SPI,TWI, UART, USB 工作電源電壓:1.8 V to 3.3 V 最大工作溫度:+ 85 C 安裝風格:SMD/SMT 封裝 / 箱體:FBGA-324 |
| MC68306CEH16B | 制造商:Freescale Semiconductor 功能描述:Microprocessor |
| MC68306CFC16B | 制造商:Rochester Electronics LLC 功能描述:INTEGRATED EC000 MPU - Bulk |
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