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參數(shù)資料
| 型號(hào)： | MC68302UM |
| 廠(chǎng)商： | Motorola, Inc. |
| 英文描述： | Integrated Multiprotocol Processor with PCMCIA |
| 中文描述： | 集成多協(xié)議處理器與PCMCIA |
| 文件頁(yè)數(shù)： | 376/480頁(yè) |
| 文件大小： | 1815K |
| 代理商： | MC68302UM |
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MC68302 Applications
D-26
MC68302 USER’S MANUAL
MOTOROLA
D.5.6 External Cycles Examples
If the MC68302 is the current bus master and no other internal or external resources are ar-
bitrating for the bus, then the IDMA will obtain bus mastership and perform the data move-
ment cycles when the DREQ signal meets the asynchronous setup time prior to the falling
edge of clock.
Figure D-7 shows the sequence of a peripheral requesting a data transfer, the IDMA reading
data from memory and then writing the data to the peripheral. The source and destination
size are the same for this case. DREQ is sampled on the falling edge of CLK and causes
the BGACK signal to assert at the conclusion of the current M68000 core bus cycle. The
IDMA performs a read cycle using the SAPR to obtain data and then performs a write cycle
to place data in the address specified in the DAPR. The fact that DACK asserts in the write
cycle indicates that data is being transferred to the requesting peripheral. Note that the BR
and BG pins are not affected by the IDMA in this example. They only activate when the de-
vice is in the disable CPU mode (see 3.8.4 Disable CPU Logic (M68000)).
相關(guān)PDF資料 |
PDF描述 |
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| MC68306CFC16B | 制造商:Rochester Electronics LLC 功能描述:INTEGRATED EC000 MPU - Bulk |
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