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參數資料
| 型號： | MC68H(R)C08JL3 |
| 廠商： | Motorola, Inc. |
| 英文描述： | HCMOS Microcontroller Unit |
| 中文描述： | HCMOS微控制器 |
| 文件頁數： | 131/198頁 |
| 文件大?。?/td> | 2403K |
| 代理商： | MC68H(R)C08JL3 |
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Analog-to-Digital Converter (ADC)
Interrupts
MC68H(R)C08JL3
—
Rev. 4
Technical Data
MOTOROLA
Analog-to-Digital Converter (ADC)
For More Information On This Product,
Go to: www.freescale.com
131
11.4.5 Accuracy and Precision
The conversion process is monotonic and has no missing codes.
11.5 Interrupts
When the AIEN bit is set, the ADC module is capable of generating a
CPU interrupt after each ADC conversion. A CPU interrupt is generated
if the COCO bit is at logic 0. The COCO bit is not used as a conversion
complete flag when interrupts are enabled.
11.6 Low-Power Modes
The following subsections describe the ADC in low-power modes.
11.6.1 Wait Mode
The ADC continues normal operation during wait mode. Any enabled
CPU interrupt request from the ADC can bring the MCU out of wait
mode. If the ADC is not required to bring the MCU out of wait mode,
power down the ADC by setting the CH[4:0] bits in the ADC Status and
Control register to logic 1’s before executing the WAIT instruction.
11.6.2 Stop Mode
The ADC module is inactive after the execution of a STOP instruction.
Any pending conversion is aborted. ADC conversions resume when the
MCU exits stop mode. Allow one conversion cycle to stabilize the analog
circuitry before attempting a new ADC conversion after exiting stop
mode.
11.7 I/O Signals
The ADC module has 12 channels that are shared with I/O port B and
port D.
F
Freescale Semiconductor, Inc.
n
.
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PDF描述 |
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