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您現在的位置：買賣IC網 > PDF目錄22061 > MSC7112VM1000 (Freescale Semiconductor)DSP 16BIT W/DDR CTRLR 400-MAPBGA PDF資料下載

參數資料

型號：	MSC7112VM1000
廠商：	Freescale Semiconductor
文件頁數：	12/56頁
文件大小：	0K
描述：	DSP 16BIT W/DDR CTRLR 400-MAPBGA
標準包裝：	90
系列：	StarCore
類型：	定點
接口：	主機接口，I²C，UART
時鐘速率：	266MHz
非易失內存：	ROM（8 kB）
芯片上RAM：	208kB
電壓 - 輸入/輸出：	3.30V
電壓 - 核心：	1.20V
工作溫度：	-40°C ~ 105°C
安裝類型：	表面貼裝
封裝/外殼：	400-LFBGA
供應商設備封裝：	400-MAPBGA（17x17）
包裝：	托盤

MSC7112 Low-Cost 16-bit DSP with DDR Controller Data Sheet, Rev. 11

Freescale Semiconductor

Table of Contents

Pin Assignments . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .4

1.1

MAP-BGA Ball Layout Diagrams . . . . . . . . . . . . . . . . . .4

1.2

Signal List By Ball Location. . . . . . . . . . . . . . . . . . . . . . .6

Specifications . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .17

2.1

Maximum Ratings . . . . . . . . . . . . . . . . . . . . . . . . . . . . .17

2.2

2.3

Thermal Characteristics . . . . . . . . . . . . . . . . . . . . . . . .18

2.4

DC Electrical Characteristics . . . . . . . . . . . . . . . . . . . .19

2.5

AC Timings . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .20

Hardware Design Considerations . . . . . . . . . . . . . . . . . . . . . .38

3.1

Thermal Design Considerations . . . . . . . . . . . . . . . . . .38

3.2

Power Supply Design Considerations. . . . . . . . . . . . . .39

3.3

Estimated Power Usage Calculations. . . . . . . . . . . . . .46

3.4

Reset and Boot . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .48

3.5

DDR Memory System Guidelines . . . . . . . . . . . . . . . . .50

Ordering Information. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .53

Package Information. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .54

Product Documentation . . . . . . . . . . . . . . . . . . . . . . . . . . . . .54

Revision History . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .55

List of Figures

Figure 1.

MSC7112 Block Diagram. . . . . . . . . . . . . . . . . . . . . . . 3

Figure 2.

MSC7112 Molded Array Process-Ball Grid Array

(MAP-BGA), Top View . . . . . . . . . . . . . . . . . . . . . . . . . 4

Figure 3.

MSC7112 Molded Array Process-Ball Grid Array

(MAP-BGA), Bottom View . . . . . . . . . . . . . . . . . . . . . . 5

Figure 4.

Timing Diagram for a Reset Configuration Write . . . . 24

Figure 5.

DDR DRAM Input Timing Diagram . . . . . . . . . . . . . . 24

Figure 6.

DDR DRAM Output Timing Diagram . . . . . . . . . . . . . 26

Figure 7.

DDR DRAM AC Test Load . . . . . . . . . . . . . . . . . . . . . 26

Figure 8.

TDM Receive Signals. . . . . . . . . . . . . . . . . . . . . . . . . 27

Figure 9.

TDM Transmit Signals . . . . . . . . . . . . . . . . . . . . . . . . 27

Figure 10. Read Timing Diagram, Single Data Strobe . . . . . . . . 29

Figure 11.

Read Timing Diagram, Double Data Strobe . . . . . . . . 30

Figure 12. Write Timing Diagram, Single Data Strobe. . . . . . . . . 30

Figure 13. Write Timing Diagram, Double Data Strobe . . . . . . . . 31

Figure 14. Host DMA Read Timing Diagram, HPCR[OAD] = 0 . . 31

Figure 15. Host DMA Write Timing Diagram, HPCR[OAD] = 0 . . 32

Figure 16. I2C Timing Diagram . . . . . . . . . . . . . . . . . . . . . . . . . . 33

Figure 17. UART Input Timing . . . . . . . . . . . . . . . . . . . . . . . . . . . 34

Figure 18. UART Output Timing . . . . . . . . . . . . . . . . . . . . . . . . . 34

Figure 19. EE Pin Timing. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 34

Figure 20. EVNT Pin Timing . . . . . . . . . . . . . . . . . . . . . . . . . . . . 35

Figure 21. GPI/GPO Pin Timing . . . . . . . . . . . . . . . . . . . . . . . . . 35

Figure 22. Test Clock Input Timing Diagram . . . . . . . . . . . . . . . . 36

Figure 23. Boundary Scan (JTAG) Timing Diagram . . . . . . . . . . 37

Figure 24. Test Access Port Timing Diagram . . . . . . . . . . . . . . . 37

Figure 25. TRST Timing Diagram . . . . . . . . . . . . . . . . . . . . . . . . 37

Figure 26. Voltage Sequencing Case 1 . . . . . . . . . . . . . . . . . . . . 40

Figure 27. Voltage Sequencing Case 2 . . . . . . . . . . . . . . . . . . . . 41

Figure 28. Voltage Sequencing Case 3 . . . . . . . . . . . . . . . . . . . . 42

Figure 29. Voltage Sequencing Case 4 . . . . . . . . . . . . . . . . . . . . 43

Figure 30. Voltage Sequencing Case 5 . . . . . . . . . . . . . . . . . . . . 44

Figure 31. PLL Power Supply Filter Circuits . . . . . . . . . . . . . . . . 45

Figure 32. SSTL Termination Techniques . . . . . . . . . . . . . . . . . . 50

Figure 33. SSTL Power Value . . . . . . . . . . . . . . . . . . . . . . . . . . . 51

相關PDF資料	PDF描述
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相關代理商/技術參數	參數描述
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MSC7113VF1000	功能描述:DSP 16BIT W/DDR CTRLR 400-MAPBGA RoHS:否類別:集成電路 (IC) >> 嵌入式 - DSP（數字式信號處理器）系列:StarCore 標準包裝:40 系列:TMS320DM64x, DaVinci™ 類型:定點接口:I²C，McASP，McBSP 時鐘速率:400MHz 非易失內存:外部芯片上RAM:160kB 電壓 - 輸入/輸出:3.30V 電壓 - 核心:1.20V 工作溫度:0°C ~ 90°C 安裝類型:表面貼裝封裝/外殼:548-BBGA，FCBGA 供應商設備封裝:548-FCBGA（27x27）包裝:托盤配用:TMDSDMK642-0E-ND - DEVELPER KIT W/NTSC CAMERA296-23038-ND - DSP STARTER KIT FOR TMS320C6416296-23059-ND - FLASHBURN PORTING KIT296-23058-ND - EVAL MODULE FOR DM642TMDSDMK642-ND - DEVELOPER KIT W/NTSC CAMERA
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