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參數資料
| 型號： | W88227F |
| 廠商： | WINBOND ELECTRONICS CORP |
| 元件分類： | 消費家電 |
| 英文描述： | ATAPI CD-ROM Decoder(支持ATAPI標準的CD-ROM解碼器) |
| 中文描述： | SPECIALTY CONSUMER CIRCUIT, PQFP128 |
| 封裝： | PLASTIC, QFP-128 |
| 文件頁數： | 51/116頁 |
| 文件大小： | 787K |
| 代理商： | W88227F |
第1頁第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁第27頁第28頁第29頁第30頁第31頁第32頁第33頁第34頁第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁第48頁第49頁第50頁當前第51頁第52頁第53頁第54頁第55頁第56頁第57頁第58頁第59頁第60頁第61頁第62頁第63頁第64頁第65頁第66頁第67頁第68頁第69頁第70頁第71頁第72頁第73頁第74頁第75頁第76頁第77頁第78頁第79頁第80頁第81頁第82頁第83頁第84頁第85頁第86頁第87頁第88頁第89頁第90頁第91頁第92頁第93頁第94頁第95頁第96頁第97頁第98頁第99頁第100頁第101頁第102頁第103頁第104頁第105頁第106頁第107頁第108頁第109頁第110頁第111頁第112頁第113頁第114頁第115頁第116頁
Preliminary/Confidential
Subject to change without notice
W88227F/W88227QD
- 47 -
1999/10/1 Rev: 0.70
CTRLW - Control-Write Register - (write 10h)
This register is 0 after chip reset, host reset, firmware reset and decoder reset.
Bit 7:
Bit 6:
reserved
SWEN - Synchronized Write Enable
If this bit is high, the change of
BUFEN (0Ah.w2)
will be synchronized to the end of next sector sync.
The buffering of C2PO flags is also controlled by this bit if
C2WEN (10h.w2)
and
BUFEN (0AH.w2)
are both enabled. This function prevents buffering of an incomplete block.
Bit 5:
SDSS - Subcode and DSP Sync Synchronization
This bit provides synchronization of CD-DA format data. If this bit is high, the writing of incoming
serial data to the external RAM will start at the first left-channel lower-byte following the end of
subcode block. Note that this bit should not be used when subcode logic is not enabled.
Bit 4:
DCKEN - DSP Clock Enable
If this bit is high, clock from DSP is used by internal decoder logic. DCKEN should be set high
before
DECEN (0Ah.w7)
is set high.
Bit 3,0: reserved
Bit 2:
C2WEN - C2 Flag Write Enable
If this bit and
BUFEN (0Ah.w2)
are both high, the C2 flags of incoming serial data will be latched into
the external RAM. This operation is synchronized to the end of sync if
SWEN (10h.w6)
is high.
ECCRST - ECC logic reset trigger
Bit 1:
Setting this bit to high resets decoding logic, including:
SRIEN (01h.w5)
←
0
CTRL0 (0Ah,w)
←
00h
CTRL1 (0Bh,w)
←
00h
STAT0-2 (0Ch-0Eh,r)
←
00h
STAT3 (0Fh,r)
←
80h
TARSTA (80h,r)
←
00h
ECCRST is automatically cleared by itself.
Bit 0:
DSPRST - DSP interface reset trigger
Setting this bit to high resets dsp interface. DSPRST is automatically cleared by itself.
相關PDF資料 |
PDF描述 |
|---|---|
| W88227QD | ATAPI CD-ROM Decoder(支持ATAPI標準的CD-ROM解碼器) |
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| W89C841F | 3-IN - 1 10/100M FAST ETHERNET CONTROLLER |
相關代理商/技術參數 |
參數描述 |
|---|---|
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| W88631F | 制造商:WINBOND 制造商全稱:Winbond 功能描述:VCD 4X RF AMP/DIGITAL SERVO & DSP |
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