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參數資料
| 型號： | W942508CH-75 |
| 廠商： | WINBOND ELECTRONICS CORP |
| 元件分類： | DRAM |
| 英文描述： | 8M x 4 BANKS x 8 BIT DDR SDRAM |
| 中文描述： | 32M X 8 DDR DRAM, 0.75 ns, PDSO66 |
| 封裝： | 0.400 X 0.875 INCH, 0.65 MM PITCH, TSOP2-66 |
| 文件頁數： | 8/47頁 |
| 文件大小： | 1317K |
| 代理商： | W942508CH-75 |
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W942508CH
- 8 -
7. ELECTRICAL CHARACTERISTICS
7.1 Absolute Maximum Ratings
PARAMETER
SYMBOL
RATING
-0.3
V
DDQ
+0.3
-0.3
3.6
0
70
-55
150
UNIT
Input/Output Voltage
V
IN
, V
OUT
V
Power Supply Voltage
V
DD
, V
DDQ
V
Operating Temperature
T
OPR
°
C
°
C
°
C
W
Storage Temperature
T
STG
Soldering Temperature (10s)
T
SOLDER
260
Power Dissipation
Short Circuit Output Current
P
D
I
OUT
1
50
mA
Note: Exposure to conditions beyond those listed under Absolute Maximum Ratings may adversely affect the life and reliability
of the device.
7.2 Recommended DC Operating Conditions
(T
A
= 0 to 70
°
C)
SYMBOL
PARAMETER
MIN.
TYP.
MAX.
UNIT
NOTES
V
DD
Power Supply Voltage
Power Supply Voltage
(for I/O Buffer)
2.3
2.5
2.7
V
2
V
DDQ
2.3
2.5
V
DD
V
2
V
REF
Input reference Voltage
0.49 x V
DDQ
0.50 x V
DDQ
0.51 x V
DDQ
V
2, 3
V
TT
Termination Voltage (System)
V
REF
-0.04
VREF
V
REF
+0.04
V
2, 8
V
IH (DC)
Input High Voltage (DC)
V
REF
+0.15
-
V
DDQ
+0.3
V
2
V
IL (DC)
Input Low Voltage (DC)
Differential Clock DC Input
Voltage
-0.3
-
V
REF
-0.15
V
2
V
ICK (DC)
-0.3
-
V
DDQ
+0.3
V
15
V
ID (DC)
Input Differential Voltage.
CLK and
CLK
inputs (DC)
0.36
-
V
DDQ
+0.6
V
13, 15
V
IH (AC)
Input High Voltage (AC)
V
REF
+0.31
-
-
V
2
V
IL (AC)
Input Low Voltage (AC)
-
-
V
REF
-0.31
V
2
V
ID (AC)
Input Differential Voltage.
CLK and
CLK
inputs (AC)
0.7
-
V
DDQ
+0.6
V
13, 15
V
X (AC)
Differential AC input Cross
Point Voltage
V
DDQ
/2 -0.2
-
V
DDQ
/2 +0.2
V
12, 15
V
ISO (AC)
Differential Clock AC Middle
Point
V
DDQ
/2 -0.2
-
V
DDQ
/2 +0.2
V
14, 15
Notes: Undershoot Limit: V
IL
(min) = -0.9V with a pulse width < 5 nS
Overshoot Limit: V
IH
(max) = V
DD
Q +0.9V with a pulse width < 5 nS
V
IH (DC)
and V
IL (DC)
are levels to maintain the current logic state.
V
IH (AC)
and V
IL (AC)
are levels to change to the new logic state.
相關PDF資料 |
PDF描述 |
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參數描述 |
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