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參數(shù)資料
| 型號(hào)： | EPM7128SLC84-6 |
| 廠商： | Altera |
| 文件頁數(shù)： | 30/66頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC MAX 7000 CPLD 128 84-PLCC |
| 標(biāo)準(zhǔn)包裝： | 75 |
| 系列： | MAX® 7000 |
| 可編程類型： | 系統(tǒng)內(nèi)可編程 |
| 最大延遲時(shí)間 tpd(1)： | 6.0ns |
| 電壓電源 - 內(nèi)部： | 4.75 V ~ 5.25 V |
| 邏輯元件/邏輯塊數(shù)目： | 8 |
| 宏單元數(shù)： | 128 |
| 門數(shù)： | 2500 |
| 輸入/輸出數(shù)： | 68 |
| 工作溫度： | 0°C ~ 70°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 84-LCC（J 形引線） |
| 供應(yīng)商設(shè)備封裝： | 84-PLCC（29.31x29.31） |
| 包裝： | 托盤 |
| 產(chǎn)品目錄頁面： | 604 (CN2011-ZH PDF) |
| 其它名稱： | 544-2035 EPM7128SLC84-6-ND |
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36
Altera Corporation
MAX 7000 Programmable Logic Device Family Data Sheet
Table 24. MAX 7000 & MAX 7000E Internal Timing Parameters
Symbol
Parameter
Conditions
Speed Grade
Unit
MAX 7000E (-12P)
MAX 7000 (-12)
MAX 7000E (-12)
Min
Max
Min
Max
tIN
Input pad and buffer delay
1.0
2.0
ns
tIO
I/O input pad and buffer delay
1.0
2.0
ns
tFIN
Fast input delay
1.0
ns
tSEXP
Shared expander delay
7.0
ns
tPEXP
Parallel expander delay
1.0
ns
tLAD
Logic array delay
7.0
5.0
ns
tLAC
Logic control array delay
5.0
ns
tIOE
Internal output enable delay
2.0
ns
tOD1
Output buffer and pad delay
Slow slew rate = off
VCCIO = 5.0 V
C1 = 35 pF
1.0
3.0
ns
tOD2
Output buffer and pad delay
Slow slew rate = off
VCCIO = 3.3 V
C1 = 35 pF (7)
2.0
4.0
ns
tOD3
Output buffer and pad delay
Slow slew rate = on
VCCIO = 5.0 V or 3.3 V
C1 = 35 pF (2)
5.0
7.0
ns
tZX1
Output buffer enable delay
Slow slew rate = off
VCCIO = 5.0 V
C1 = 35 pF
6.0
ns
tZX2
Output buffer enable delay
Slow slew rate = off
VCCIO = 3.3 V
C1 = 35 pF (7)
7.0
ns
tZX3
Output buffer enable delay
Slow slew rate = on
VCCIO = 5.0 V or 3.3 V
C1 = 35 pF (2)
10.0
ns
tXZ
Output buffer disable delay
C1 = 5 pF
6.0
ns
tSU
Register setup time
1.0
4.0
ns
tH
Register hold time
6.0
4.0
ns
tFSU
Register setup time of fast input
4.0
2.0
ns
tFH
Register hold time of fast input
0.0
2.0
ns
tRD
Register delay
2.0
1.0
ns
tCOMB
Combinatorial delay
2.0
1.0
ns
tIC
Array clock delay
5.0
ns
tEN
Register enable time
7.0
5.0
ns
tGLOB
Global control delay
2.0
0.0
ns
tPRE
Register preset time
4.0
3.0
ns
tCLR
Register clear time
4.0
3.0
ns
tPIA
PIA delay
1.0
ns
tLPA
Low-power adder
12.0
ns
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| EPM7128SLC84-7N | 功能描述:CPLD - 復(fù)雜可編程邏輯器件 CPLD - MAX 7000 128 Macro 68 IOs RoHS:否 制造商:Lattice 系列: 存儲(chǔ)類型:EEPROM 大電池?cái)?shù)量:128 最大工作頻率:333 MHz 延遲時(shí)間:2.7 ns 可編程輸入/輸出端數(shù)量:64 工作電源電壓:3.3 V 最大工作溫度:+ 90 C 最小工作溫度:0 C 封裝 / 箱體:TQFP-100 |
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