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參數(shù)資料
| 型號： | MC68040V |
| 廠商： | Motorola, Inc. |
| 英文描述： | 32-Bit Microprocessor(32位微處理器) |
| 中文描述： | 32位微處理器（32位微處理器） |
| 文件頁數(shù)： | 391/442頁 |
| 文件大?。?/td> | 2582K |
| 代理商： | MC68040V |
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MOTOROLA
M68040 USER’S MANUAL
B-15
MC68EC040
REV2.3 (01/31/2000)
B.7.7 Input AC Timing Specifications
(see Figures B-8 to B-12)
20 MHz
25 MHz
33 MHz
40 MHz
Unit
Num
Characteristic
Min
Max
Min
Max
Min
Max
Min
Max
15
Data-In Valid to BCLK (Setup)
6
—
5
—
4
—
3
—
nS
16
BCLK to Data-In Invalid (Hold)
5
—
4
—
4
—
3
—
nS
17
BCLK to Data-In High Impedance
(Read Followed by Write)
—
61
—
49
—
36.5
—
30.25
nS
22a
TA Valid to BCLK (Setup)
12.5
—
10
—
10
—
8
—
nS
22b
TEA Valid to BCLK (Setup)
12.5
—
10
—
10
—
9
—
nS
22c
TCI Valid to BCLK (Setup)
12.5
—
10
—
10
—
9
—
nS
22d
TBI Valid to BCLK (Setup)
14
—
11
—
10
—
9
—
nS
23
BCLK to TA, TEA, TCI, TBI In-
valid (Hold)
2.5
—
2
—
2
—
2
—
nS
24
AVEC Valid to BCLK (Setup)
6
—
5
—
5
—
5
—
nS
25
BCLK to AVEC Invalid (Hold)
2.5
—
2
—
2
—
2
—
nS
41a
BB Valid to BCLK (Setup)
8
—
7
—
7
—
7
—
nS
41b
BG Valid to BCLK (Setup)
10
—
8
—
7
—
7
—
nS
41c
CDIS Valid to BCLK (Setup)
12.5
—
10
—
8
—
8
—
nS
41d
IPL Valid to BCLK (Setup)
5
—
4
—
3
—
3
—
nS
42
BCLK to BB, BG, CDIS, IPL In-
valid
(Hold)
2.5
—
2
—
2
—
2
—
nS
44a
Address Valid to BCLK (Setup)
10
—
8
—
7
—
7
—
nS
44b
SIZx Valid to BCLK (Setup)
15
—
12
—
8
—
8
—
nS
44c
TTx Valid to BCLK (Setup)
7.5
—
6
—
8.5
—
8.5
—
nS
44d
R/W Valid to BCLK (Setup)
7.7
—
6
—
5
—
5
—
nS
44e
SCx Valid to BCLK (Setup)
12.5
—
10
—
11
—
8
—
nS
45
BCLK to Address SIZx, TTx,
R/W, SCx
Invalid (Hold)
2.5
—
2
—
2
—
2
—
nS
46
TS Valid to BCLK (Setup)
6
—
5
—
9
—
7
—
nS
47
BCLK to TS Invalid (Hold)
2.5
—
2
—
2
—
2
—
nS
49
BCLK to BB High Impedance
(MC68EC040 Assumes Bus
Mastership)
—
11
—
9
—
9
—
9
nS
51
RSTI Valid to BCLK
6
—
5
—
4
—
4
—
nS
52
BCLK to RSTI Invalid
2.5
—
2
—
2
—
2
—
nS
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