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參數資料
| 型號： | MC68302CFC16 |
| 廠商： | MOTOROLA INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | Integrated Multiprotocol Processor User’s Manual |
| 中文描述： | RISC PROCESSOR, PQFP132 |
| 封裝： | PLASTIC, QFP-132 |
| 文件頁數： | 194/480頁 |
| 文件大小： | 1815K |
| 代理商： | MC68302CFC16 |
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Communications Processor (CP)
4-74
MC68302 USER’S MANUAL
MOTOROLA
the SCC mode register when that SCC is configured for HDLC. The read-write HDLC mode
register is cleared by reset.
NOF3–NOF0—Minimum Number of Flags between Frames or before Frames (0 to 15
Flags)
If NOF3–NOF0 = 0000, then no flags will be inserted between frames. Thus, the closing
flag of one frame will be followed immediately by the opening flag of the next frame in the
case of back-to-back frames.
C32—CRC16/CRC32
0 = 16-bit CCITT CRC (X16 + X12 + X5 + 1)
1 = 32-bit CCITT CRC (X32 + X26 + X23 + X22 + X16 + X12 + X11 + X10 + X8 + X7
+ X5 + X4 + X2 + X1 + 1)
FSE—Flag Sharing Enable
0 = Normal operation
1 = If NOF3–NOF0 = 0000, then a single shared flag is transmitted between back- to-
back frames. Other values of NOF3–NOF0 are decremented by one when FSE is
set. This is useful in Signaling System #7 applications.
Bit 9—Reserved for future use.
RTE—Retransmit Enable
0 = No automatic retransmission will be performed.
1 = Automatic retransmit enabled
Automatic retransmission occurs if a CTS lost condition happens on the first or second
buffer of the frame. See 4.5.12.8 HDLC Error-Handling Procedure.
FLG—Transmit Flags/Idles between Frames and Control the RTS Pin
0 = Send ones between frames; RTS is negated between frames. If NOF–NOF0 is
greater than zero, RTS will be negated for a multiple of eight transmit clocks. The
HDLC controller can transmit ones in both the NRZ and NRZI data encoding for-
mats. The CP polls the Tx BD ready bit every 16 transmit clocks.
1 = Send flags between frames. RTS is always asserted. The CP polls the Tx BD ready
bit every eight transmit clocks.
NOTE
This bit may be dynamically modified. If toggled from a one to a
zero between frames, a maximum of two additional flags will be
transmitted before the idle condition will begin. Toggling FLG will
never result in partial flags being transmitted.
15
14
13
12
11
10
9
8
7
6
5
0
NOF3 NOF2 NOF1 NOF0
C32
FSE
—
RTE
FLG
ENC
COMMON SCC MODE BITS
相關PDF資料 |
PDF描述 |
|---|---|
| MC68302CFC20 | Integrated Multiprotocol Processor User’s Manual |
| MC68302CRC16 | Integrated Multiprotocol Processor User’s Manual |
| MC68302CRC20 | Integrated Multiprotocol Processor User’s Manual |
| MC68302RC16 | Integrated Multiprotocol Processor User’s Manual |
| MC6802 | Microprocessor With Clock and Oprtional RAM |
相關代理商/技術參數 |
參數描述 |
|---|---|
| MC68302CFC16C | 功能描述:IC MPU MULTI-PROTOCOL 132-PQFP RoHS:否 類別:集成電路 (IC) >> 嵌入式 - 微處理器 系列:M683xx 標準包裝:2 系列:MPC8xx 處理器類型:32-位 MPC8xx PowerQUICC 特點:- 速度:133MHz 電壓:3.3V 安裝類型:表面貼裝 封裝/外殼:357-BBGA 供應商設備封裝:357-PBGA（25x25） 包裝:托盤 |
| MC68302CFC20 | 制造商:MOTOROLA 制造商全稱:Motorola, Inc 功能描述:Integrated Multiprotocol Processor User’s Manual |
| MC68302CFC20C | 制造商:Motorola 功能描述:68302 |
| MC68302CFE16 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Communications Controller |
| MC68302CFE20 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Communications Controller |
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