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參數資料
| 型號： | MC68302CFC16 |
| 廠商： | MOTOROLA INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | Integrated Multiprotocol Processor User’s Manual |
| 中文描述： | RISC PROCESSOR, PQFP132 |
| 封裝： | PLASTIC, QFP-132 |
| 文件頁數： | 199/480頁 |
| 文件大小： | 1815K |
| 代理商： | MC68302CFC16 |
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Communications Processor (CP)
MOTOROLA
MC68302 USER’S MANUAL
4-79
The first word of the Tx BD contains status and control bits. Bits 15–10 are prepared by the
user before transmission; bits 1–0 are set by the HDLC controller after the buffer has been
transmitted. Bit 15 is set by the user when the buffer and BD have been prepared and is
cleared by the HDLC controller after the frame has been transmitted.
R—Ready
0 = This buffer is not currently ready for transmission. The user is free to manipulate
this BD (or its associated buffer). The HDLC controller clears this bit after the buffer
has been fully transmitted or after an error condition has been encountered.
1 = The data buffer, which has been prepared for transmission by the user, has not yet
transmitted. No fields of this BD may be written by the user once this bit is set.
X—External Buffer
0 = The buffer associated with this BD is in internal dual-port RAM.
1 = The buffer associated with this BD is in external memory.
W—Wrap (Final BD in Table)
0 = This is not the last BD in the Tx BD table.
1 = This is the last BD in the Tx BD table. After this buffer has been used, the HDLC
controller will transmit data from the first BD in the table.
NOTE
The user is required to set the wrap bit in one of the first eight
BDs; otherwise, errant behavior may occur.
I—Interrupt
0 = No interrupt is generated after this buffer has been serviced.
1 = Either TXB or TXE in the HDLC event register will be set when this buffer has been
serviced by the HDLC controller, which can cause an interrupt.
L—Last
0 = This is not the last buffer in the frame.
1 = This is the last buffer in the current frame.
TC—Tx CRC
This bit is valid only when the last (L) bit is set.
0 = Transmit the closing flag after the last data byte. This setting can be used for test-
ing purposes to send a “bad” CRC after the data.
1 = Transmit the CRC sequence after the last data byte.
Bits 9–2—Reserved for future use.
The following status bits are written by the HDLC controller after it has finished transmitting
the associated data buffer.
相關PDF資料 |
PDF描述 |
|---|---|
| MC68302CFC20 | Integrated Multiprotocol Processor User’s Manual |
| MC68302CRC16 | Integrated Multiprotocol Processor User’s Manual |
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| MC6802 | Microprocessor With Clock and Oprtional RAM |
相關代理商/技術參數 |
參數描述 |
|---|---|
| MC68302CFC16C | 功能描述:IC MPU MULTI-PROTOCOL 132-PQFP RoHS:否 類別:集成電路 (IC) >> 嵌入式 - 微處理器 系列:M683xx 標準包裝:2 系列:MPC8xx 處理器類型:32-位 MPC8xx PowerQUICC 特點:- 速度:133MHz 電壓:3.3V 安裝類型:表面貼裝 封裝/外殼:357-BBGA 供應商設備封裝:357-PBGA（25x25） 包裝:托盤 |
| MC68302CFC20 | 制造商:MOTOROLA 制造商全稱:Motorola, Inc 功能描述:Integrated Multiprotocol Processor User’s Manual |
| MC68302CFC20C | 制造商:Motorola 功能描述:68302 |
| MC68302CFE16 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Communications Controller |
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