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參數資料
| 型號： | MC68302CFC16 |
| 廠商： | MOTOROLA INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | Integrated Multiprotocol Processor User’s Manual |
| 中文描述： | RISC PROCESSOR, PQFP132 |
| 封裝： | PLASTIC, QFP-132 |
| 文件頁數： | 301/480頁 |
| 文件大小： | 1815K |
| 代理商： | MC68302CFC16 |
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Electrical Characteristics
MOTOROLA
MC68302 USER’S MANUAL
6-13
6.9 AC ELECTRICAL SPECIFICATIONS—DMA
(see Figure 6-6 and Figure 6-7)
NOTES:
1. DREQ is sampled on the falling edge of CLK in cycle steal and burst modes.
2. If #80 is satisfied for DREQ, #81 may be ignored.
3. BR will not be asserted while BG, HALT, or BERR is asserted.
4. Specifications are for DISABLE CPU mode only.
5. DREQ, DACK, and DONE do not apply to the SDMA channels.
6. DMA and SDMA read and write cycle timing is the same as that for the M68000 core.
Num.
Characteristic
Symbol
16.67 MHz
20 MHz
25 MHz
Unit
Min
Max
Min
Max
Min
Max
80
DREQ Asynchronous Setup Time (see Note
1)
t
REQASI
15
—
15
—
10
—
ns
81
DREQ Width Low (see Note 2)
t
REQL
2
—
2
—
2
—
clks
82
DREQ Low to BR Low (see Notes 3 and 4)
t
REQLBRL
—
2
—
2
—
2
clks
83
Clock High to BR Low (see Notes 3 and 4)
t
CHBRL
—
30
—
25
—
20
ns
84
Clock High to BR High Impedance (see
Notes 3 and 4)
t
CHBRZ
—
30
—
25
—
20
ns
85
BGACK Low to BR High Impedance (see
Notes 3 and 4)
t
BKLBRZ
30
—
25
—
20
—
ns
86
Clock High to BGACK Low
t
CHBKL
—
30
—
25
—
20
ns
87
AS and BGACK High (the Latest One) to
BGACK Low (when BG Is Asserted)
t
ABHBKL
1.5
2.5
+30
1.5
2.5
+25
1.5
2.5
+20
clks
ns
88
BG Low to BGACK Low (No Other Bus
Master) (see Notes 3 and 4)
t
BGLBKL
1.5
2.5
+30
1.5
2.5
+25
1.5
2.5
+20
clks
ns
89
BR High Impedance to BG High (see Notes 3
and 4)
t
BRHBGH
0
—
0
—
0
—
ns
90
Clock on which BGACK Low to Clock on
which AS Low
t
CLBKLAL
2
2
2
2
2
2
clks
91
Clock High to BGACK High
t
CHBKH
—
30
—
25
—
20
ns
92
Clock Low to BGACK High Impedance
t
CLBKZ
—
15
—
15
—
10
ns
93
Clock High to DACK Low
t
CHACKL
—
30
—
25
—
20
ns
94
Clock Low to DACK High
t
CLACKH
—
30
—
25
—
20
ns
95
Clock High to DONE Low (Output)
t
CHDNL
—
30
—
25
—
20
ns
96
Clock Low to DONE High Impedance
t
CLDNZ
—
30
—
25
—
20
ns
97
DONE Input Low to Clock Low (Asynchro-
nous Setup)
t
DNLTCH
15
—
15
—
10
—
ns
相關PDF資料 |
PDF描述 |
|---|---|
| MC68302CFC20 | Integrated Multiprotocol Processor User’s Manual |
| MC68302CRC16 | Integrated Multiprotocol Processor User’s Manual |
| MC68302CRC20 | Integrated Multiprotocol Processor User’s Manual |
| MC68302RC16 | Integrated Multiprotocol Processor User’s Manual |
| MC6802 | Microprocessor With Clock and Oprtional RAM |
相關代理商/技術參數 |
參數描述 |
|---|---|
| MC68302CFC16C | 功能描述:IC MPU MULTI-PROTOCOL 132-PQFP RoHS:否 類別:集成電路 (IC) >> 嵌入式 - 微處理器 系列:M683xx 標準包裝:2 系列:MPC8xx 處理器類型:32-位 MPC8xx PowerQUICC 特點:- 速度:133MHz 電壓:3.3V 安裝類型:表面貼裝 封裝/外殼:357-BBGA 供應商設備封裝:357-PBGA（25x25） 包裝:托盤 |
| MC68302CFC20 | 制造商:MOTOROLA 制造商全稱:Motorola, Inc 功能描述:Integrated Multiprotocol Processor User’s Manual |
| MC68302CFC20C | 制造商:Motorola 功能描述:68302 |
| MC68302CFE16 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Communications Controller |
| MC68302CFE20 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Communications Controller |
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