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參數資料
| 型號： | MC68EN360FE33 |
| 廠商： | MOTOROLA INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | QUad Integrated Communications Controller Users Manual |
| 中文描述： | 32-BIT, 33 MHz, RISC MICROCONTROLLER, CQFP240 |
| 封裝： | CERAMIC, QFP-240 |
| 文件頁數： | 502/962頁 |
| 文件大小： | 2817K |
| 代理商： | MC68EN360FE33 |
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Serial Communication Controllers (SCCs)
7-178
MC68360 USER’S MANUAL
MOTOROLA
CRC Error
.
When this error occurs, the channel writes the received CRC to the data buffer,
closes the buffer, sets the CR bit in the Rx BD, and generates the RXF interrupt (if enabled).
The channel also increments the CRC error counter. After receiving a frame with a CRC
error, the receiver enters hunt mode. (An immediately following back-to-back frame will still
be received.) CRC checking cannot be disabled, but the CRC error may be ignored if check-
ing is not required.
7.10.17.8 HDLC MODE REGISTER (PSMR).
Each HDLC mode register is a 16-bit, mem-
ory-mapped, read-write register that controls SCC operation. The term HDLC mode register
refers to the PSMR of the SCC when that SCC is configured for HDLC. The HDLC mode
register is cleared at reset.
NOF—Number of Flags
Minimum number of flags between frames or before frames (0 to 15 flags). If NOF = 0000,
then no flags will be inserted between frames. Thus, the closing flag of one frame will be
immediately followed by the opening flag of the next frame in the case of back-to-back
frames. These bits may be modified on the fly.
CRC—CRC Selection
00 = 16-Bit CCITT-CRC (HDLC). (X16 + X12 + X5 + 1)
01 = Reserved.
10 = 32-Bit CCITT-CRC (Ethernet and HDLC). (X32 + X26 + X23 + X22 + X16 + X12
+ X11 + X10 + X8 + X7 + X5 + X4 + X2 + X1 +1)
11 = Reserved.
RTE—Retransmit Enable
0 = No retransmission
1 = Automatic frame retransmission is enabled. This is particularly useful in the HDLC
Bus protocol and ISDN applications where multiple HDLC controllers may be col-
liding on a single channel. Note that retransmission only occurs if the CTS lost hap-
pens on the first or second buffer of the frame.
Bits 8, 2–0—Reserved
FSE—Flag Sharing Enable
This bit is only valid if the RTSM bit is set in GSMR This bit may be modified on the fly.
0 = Normal operation
1 = If NOF3–NOF0 = 0000, then a single shared flag is transmitted between back-to-
back frames. Other values of NOF3–NOF0 are decremented by one when FSE is
set. This is useful in Signaling System #7 applications.
15
14
13
12
11
10
9
8
—
7
6
5
4
3
2
1
—
0
NOF
CRC
RTE
FSE
DRT
BUS
BRM
MFF
相關PDF資料 |
PDF描述 |
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| MC68EN360RC25C | 制造商:Motorola Inc 功能描述: |
| MC68EN360RC25L | 功能描述:微處理器 - MPU QUICC ETHRN RoHS:否 制造商:Atmel 處理器系列:SAMA5D31 核心:ARM Cortex A5 數據總線寬度:32 bit 最大時鐘頻率:536 MHz 程序存儲器大小:32 KB 數據 RAM 大小:128 KB 接口類型:CAN, Ethernet, LIN, SPI,TWI, UART, USB 工作電源電壓:1.8 V to 3.3 V 最大工作溫度:+ 85 C 安裝風格:SMD/SMT 封裝 / 箱體:FBGA-324 |
| MC68EN360RC25V | 制造商:MOTOROLA 制造商全稱:Motorola, Inc 功能描述:QUad Integrated Communications Controller Users Manual |
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