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參數資料
| 型號： | MC68EN360RC25 |
| 廠商： | MOTOROLA INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | QUad Integrated Communications Controller Users Manual |
| 中文描述： | RISC MICROCONTROLLER, CPGA241 |
| 封裝： | PGA-241 |
| 文件頁數： | 765/962頁 |
| 文件大小： | 2817K |
| 代理商： | MC68EN360RC25 |
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Applications
9-45
MC68360 USER’S MANUAL
MOTOROLA
9.4.2.7 EEPROM.
Figure 9-14 shows the interface to an EEPROM device to give a small
amount of nonvolatile storage. Although both the MC68EC040 and the QUICC may access
the EEPROM, it is most likely that only the MC68EC040 will access the EEPROM. The
inverter is only required if DRAM is used elsewhere in the system, since the OE function is
lost when the AMUX pin is used.
The EEPROM device sits on just the D7–D0 data pins. Thus, when the MC68EC040
accesses the EEPROM, the only valid data that is read or written is on the D7–D0 pins (i.e.,
byte 3). Thus, reads or writes to successive locations of the EEPROM will require the
address to be incremented by 4 each time. Additionally, the CS4 pin should be programmed
to respond to a full 32-Kbyte area, even though only 8 Kbytes are present.
After a write is made, software is responsible for waiting the appropriate time (e.g., 10 ms)
or for performing data polling to see if the newly written data byte is correct.
Figure 9-14. 8-Kbyte EEPROM Bank—8 Bits Wide
9.4.2.8 DRAM SIMM.
Figure 9-15 shows the interface to an MCM36100S DRAM single in-
line memory module (SIMM). Both the MC68EC040 and the QUICC can access the DRAM.
When the QUICC is a slave to an external MC68EC040, the address multiplexing for the
DRAM must be done externally to the QUICC, which is accomplished in the three F157 mul-
tiplexers. The external address multiplexing scheme was chosen to allow the QUICC to pro-
vide burst accesses by the MC68EC040, using the BADD3–BADD2 pins. The QUICC can
also use these pins as its A3–A2 address lines during its own accesses to the DRAM. In
addition, two of the multiplexer outputs are unused in this design, allowing expansion to
WE (Write)
A0
A1
A2
A3
A4
A5
A6
A7
A8
A9
A10
A11
A12
DQ0
DQ1
DQ2
DQ3
DQ4
DQ5
DQ6
DQ7
CE (Enable)
OE
2864
8K
×
8
EEPROM
A14–A2
D7–D0
SYSTEMBUS AND
QUICC-GENERATED SIGNALS
CS4
R/W
WE3
BYTE 3
LOW-ORDER
BYTE
相關PDF資料 |
PDF描述 |
|---|---|
| MC68MH360FE25 | QUad Integrated Communications Controller Users Manual |
| MC68EN360RC33 | AC 4C 4#12 SKT PLUG 025 |
| MC68EN360ZP25 | QUad Integrated Communications Controller Users Manual |
| MC68MH360CFE25 | QUad Integrated Communications Controller Users Manual |
| MC68MH360CRC25 | QUad Integrated Communications Controller Users Manual |
相關代理商/技術參數 |
參數描述 |
|---|---|
| MC68EN360RC25C | 制造商:Motorola Inc 功能描述: |
| MC68EN360RC25L | 功能描述:微處理器 - MPU QUICC ETHRN RoHS:否 制造商:Atmel 處理器系列:SAMA5D31 核心:ARM Cortex A5 數據總線寬度:32 bit 最大時鐘頻率:536 MHz 程序存儲器大小:32 KB 數據 RAM 大小:128 KB 接口類型:CAN, Ethernet, LIN, SPI,TWI, UART, USB 工作電源電壓:1.8 V to 3.3 V 最大工作溫度:+ 85 C 安裝風格:SMD/SMT 封裝 / 箱體:FBGA-324 |
| MC68EN360RC25V | 制造商:MOTOROLA 制造商全稱:Motorola, Inc 功能描述:QUad Integrated Communications Controller Users Manual |
| MC68EN360RC33 | 制造商:MOTOROLA 制造商全稱:Motorola, Inc 功能描述:QUad Integrated Communications Controller Users Manual |
| MC68EN360RC33L | 功能描述:微處理器 - MPU QUICC ETHRN RoHS:否 制造商:Atmel 處理器系列:SAMA5D31 核心:ARM Cortex A5 數據總線寬度:32 bit 最大時鐘頻率:536 MHz 程序存儲器大小:32 KB 數據 RAM 大小:128 KB 接口類型:CAN, Ethernet, LIN, SPI,TWI, UART, USB 工作電源電壓:1.8 V to 3.3 V 最大工作溫度:+ 85 C 安裝風格:SMD/SMT 封裝 / 箱體:FBGA-324 |
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