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參數(shù)資料
| 型號： | MC68EN360RC25 |
| 廠商： | MOTOROLA INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | QUad Integrated Communications Controller Users Manual |
| 中文描述： | RISC MICROCONTROLLER, CPGA241 |
| 封裝： | PGA-241 |
| 文件頁數(shù)： | 823/962頁 |
| 文件大小： | 2817K |
| 代理商： | MC68EN360RC25 |
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Electrical Characteristics
MOTOROLA
MC68360 USER’S MANUAL
10-11
10.9 BUS OPERATION AC TIMING SPECIFICATIONS (CONTINUED)
Num.
Characteristic
Symbol
3.3 V/5.0 V
25.0 MHz
Min
—
5.0V
Unit
33.34MHz
Min
—
Max
30
Max
485,7
DSACKˉ
Asserted to
BERR
,
HALT
Asserted
49
CLKO1 high to BERR, RESETS, RESETH output Low
tDABA
22.5
ns
tCHRO
tDOCH
tCHDH
tRADC
tHRPW
tRPWI
tBNHN
tCHBRL
tCLRL
—
—
—
—
ns
53
Data-Out, Parity-Out Hold from CLKO1 High
0
—
0
—
ns
54
CLKO1 High to Data-Out, Parity-Out High Impedance
—
20
—
15
ns
55
R/
W
Asserted to Data Bus Impedance Change
25
—
19
—
ns
56
RESET Pulse Width (Reset Instruction)
512
—
512
—
CLKO1
56A
RESET
Pulse Width (Input from External Device)
20
—
20
—
CLKO1
57
BERR
Negated to
HALT
Negated (Rerun)
0
—
0
—
ns
58
CLKO1 High to BERR, RESETS, RESETH Driven Low
—
30
26
ns
58A
CLKO1 Low to RESETS Driven Low (upon Reset Instruction
execution only)
CLKO1 High to
BCLRO
Asserted
—
30
26
ns
60
tCHBCA
tCHBCN
tBRSU
—
20
—
15
ns
61
CLKO1 High to
BCLRO
Negated
—
20
—
15
ns
629
639
649
659
66
BR
Synchronous Setup Time
5
—
3.75
—
ns
BR
Synchronous Hold Time
tBRH
10
—
7.5
—
ns
BGACK
Synchronous Setup Time
tBGSU
5
—
3.75
—
ns
BGACK
Synchronous Hold Time
tBGH
10
—
7.5
—
ns
BR low to CLKO1 Rising Edge (040 comp. mode)
t
BRCH
tSCLDD
tSCLDS
tSCLDH
tBKST
tBKHT
tMST
tMSH
tMSH
tDSISU
tDSIH
tDSCSU
tDSCH
tDSOD
5
—
5
—
ns
70
CLKO1 Low to Data Bus Driven (Show Cycle)
0
30
0
22.5
ns
71
Data Setup Time to CLKO1 Low (Show Cycle)
10
—
7.5
—
ns
72
Data Hold from CLKO1 Low (Show Cycle)
6
—
3.75
—
ns
73
BKPT
Input Setup Time
10
—
7.5
—
ns
74
BKPT
Input Hold Time
6
—
3.75
—
ns
75
RESETH Low to Config2–0, MOD1–0, B16M valid
—
500
—
500
CLKO1
76
Config2–0
0
—
0
—
ns
77
MOD1–0 Hold Time, B16M Hold Time
10
—
10
—
CLKO1
80
DSI Input Setup Time
10
—
7.5
—
ns
81
DSI Input Hold Time
6
—
3.75
—
ns
82
DSCLK Setup Time
10
—
7.5
—
ns
83
DSCLK Hold Time
6
—
3.75
—
ns
84
DSO Delay Time
—
tcyc+
20
—
—
tcyc+ 20
ns
85
DSCLK Cycle
tDSCCYC
tFRZA
tFRZN
2
2
—
CLKO1
86
CLKO1 High to Freeze Asserted
0
35
0
26.25
ns
87
CLKO1 High to Freeze Negated
0
35
0
26.25
ns
相關(guān)PDF資料 |
PDF描述 |
|---|---|
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| MC68MH360CFE25 | QUad Integrated Communications Controller Users Manual |
| MC68MH360CRC25 | QUad Integrated Communications Controller Users Manual |
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參數(shù)描述 |
|---|---|
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| MC68EN360RC25V | 制造商:MOTOROLA 制造商全稱:Motorola, Inc 功能描述:QUad Integrated Communications Controller Users Manual |
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