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參數資料
| 型號： | MC68MH360FE25V |
| 廠商： | MOTOROLA INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | QUad Integrated Communications Controller Users Manual |
| 中文描述： | 32-BIT, 25 MHz, RISC MICROCONTROLLER, CQFP240 |
| 封裝： | CERAMIC, QFP-240 |
| 文件頁數： | 779/962頁 |
| 文件大小： | 2817K |
| 代理商： | MC68MH360FE25V |
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Applications
9-59
MC68360 USER’S MANUAL
MOTOROLA
9.6.3 Logical Interface
Communicating across the SCSI bus occurs through a series of phases. The protocol is
made up of communication cycles, where each cycle is a sequence of states and the bus
can never be in more than one state at a time. The protocol has eight phases, and each
phase performs a specific function, such as idling, arbitrating, selecting, reselecting, and
sending commands, data, messages, and status. From a hardware perspective, each phase
is determined by the SCSI bus control lines. Figure 9-20, a phase sequence diagram, shows
how the phases fit together to form the communication cycle. Some phases, such as arbi-
tration, reselection, and message out, are optional. They are used when the bus has multiple
initiators. The following list describes the different phases:
BUS-FREE—the idling state of the SCSI bus. When in this state, no SCSI device is ac-
tively using the bus, and the bus is available for subsequent users.
ARBITRATION—used to determine which device gains control of the SCSI bus. Arbitra-
tion is necessary when two or more devices are simultaneously competing to use the bus.
SELECTION—used to establish a communications link between an initiator and a target
device to perform a SCSI command. Typically, the command is a read or write function to
the target.
RESELECTION—optional phase controlled by the target. This phase allows the target to
reconnect to an initiator so that an operation that was previously started by the initiator,
but suspended by the target, can be finished.
INFORMATION-TRANSFER—includes command, data, status, and message phases.
They are entered by asserting the BSY line and negating the SEL line. The C/D, I/O, and
MSG signals are used to differentiate between the phases.
Command—allows the target to receive a command from the initiator in the form of a
command-descriptor block (CDB). It is used to tell the target which type of operation to
perform (e.g., read/write a sector from a disk). CDBs are usually 6, 10, or 12 bytes in
length.
Data—two phases: data in and data out (direction is determined by the originator). The
data phase is entered when the target negates the C/D and MSG lines and asserts (in-
put) or negates (output) the I/O line.
Message—similar to the data phase because it can be message in or message out. It
conveys information on the status of a command and is entered when the target asserts
the C/D and MSG lines during REQ and ACK handshakes. I/O has the same function
as in the data phase.
Status—used to send one status byte from the target to the initiator. This phase falls
between the data and message phases and consists of sending a good status byte if
the data transmitted was received correctly. The status phase is entered when the tar-
get asserts the C/D and I/O lines while MSG is negated.
相關PDF資料 |
PDF描述 |
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參數描述 |
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| MC68MH360RC33L | 功能描述:微處理器 - MPU QUICC 2SMC 1SPI RoHS:否 制造商:Atmel 處理器系列:SAMA5D31 核心:ARM Cortex A5 數據總線寬度:32 bit 最大時鐘頻率:536 MHz 程序存儲器大小:32 KB 數據 RAM 大小:128 KB 接口類型:CAN, Ethernet, LIN, SPI,TWI, UART, USB 工作電源電壓:1.8 V to 3.3 V 最大工作溫度:+ 85 C 安裝風格:SMD/SMT 封裝 / 箱體:FBGA-324 |
| MC68MH360VR25L | 功能描述:微處理器 - MPU QUICC 2SMC 1SPI RoHS:否 制造商:Atmel 處理器系列:SAMA5D31 核心:ARM Cortex A5 數據總線寬度:32 bit 最大時鐘頻率:536 MHz 程序存儲器大小:32 KB 數據 RAM 大小:128 KB 接口類型:CAN, Ethernet, LIN, SPI,TWI, UART, USB 工作電源電壓:1.8 V to 3.3 V 最大工作溫度:+ 85 C 安裝風格:SMD/SMT 封裝 / 箱體:FBGA-324 |
| MC68MH360VR25LR2 | 功能描述:微處理器 - MPU QUICC 2SMC 1SPI RoHS:否 制造商:Atmel 處理器系列:SAMA5D31 核心:ARM Cortex A5 數據總線寬度:32 bit 最大時鐘頻率:536 MHz 程序存儲器大小:32 KB 數據 RAM 大小:128 KB 接口類型:CAN, Ethernet, LIN, SPI,TWI, UART, USB 工作電源電壓:1.8 V to 3.3 V 最大工作溫度:+ 85 C 安裝風格:SMD/SMT 封裝 / 箱體:FBGA-324 |
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