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參數(shù)資料
| 型號： | MC68MH360RC25 |
| 廠商： | MOTOROLA INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | QUad Integrated Communications Controller Users Manual |
| 中文描述： | 32-BIT, 25 MHz, RISC MICROCONTROLLER, CPGA241 |
| 封裝： | PGA-241 |
| 文件頁數(shù)： | 133/962頁 |
| 文件大小： | 2817K |
| 代理商： | MC68MH360RC25 |
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Bus Operation
MOTOROLA
MC68360 USER’S MANUAL
4-57
3. If the 68040 requests the bus at the same time that a QUICC internal master is re-
questing the bus, the BR040ID bits are used to determine who will acquire the bus first.
4. When the QUICC no longer needs the bus, it deasserts BB and asserts BG.
The state machine for the MC68040 companion mode arbitration is shown in Figure 4-39.
Figure 4-39. MC68040 Companion Mode Bus Arbitration State Machine
IDLE
QUICC
WAITING FOR
BUS
BG
ASSERTED
QUICC INTERNAL MASTER OF HIGHER
PRIORITY THAN THE 68040 REQUIRES
EXTERNAL BUS
BG
NEGATED
HALT IS ASSERTED AND DRAMREFRESH
DOES NOT REQUIRE EXTERNAL BUS
EXTERNAL
BUS IDLE
040 OWNS
BUS
BG
ASSERTED
040 REQUESTS BUS
040 FINISHES
USE OF BUS
INTERNAL MASTER (IDMA, SDMA, OR DRAM
REFRESH) REQUESTS BUS
NOTES:
1. If the 68040 and the QUICC Internal Master requests the bus at the same time, the highest priority requester wins.
2. The transition from "040 Owns Bus" to "QUICC Waiting for Bus" may be delayed, until the write portion of an 040
locked cycle if an 040 locked cycle is in progress when the higher priority QUICC internal master requests the bus.
3. BB is only asserted by QUICC during the state "QUICC Owns Bus", otherwise BB is three-stated by the QUICC.
BB = 0
BB = 1
BG NEGATED
BB ASSERTED
040 STILL NEEDS BUS
QUICC STILL NEEDS BUS
QUICC NO LONGER NEEDS BUS
OR
HALT ASSERTED AND DRAM
REFRESH DOES NOT NEED BUS
BR IS ASSERTED BY 040 AND 040 HAS
PRIORITY OVER CURRENT QUICC
INTERNAL BUS MASTER
QUICC
OWNS BUS
相關(guān)PDF資料 |
PDF描述 |
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