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參數資料
| 型號： | MC88915FN70PLCC |
| 廠商： | Motorola, Inc. |
| 英文描述： | Low Skew CMOS PLL Clock Driver |
| 中文描述： | 低偏移的CMOS PLL時鐘驅動器 |
| 文件頁數： | 15/20頁 |
| 文件大小： | 216K |
| 代理商： | MC88915FN70PLCC |
MC88915TFN55/70/100/133/160
TIMING SOLUTIONS
BR1333 — Rev 6
15
MOTOROLA
8. The lock indicator pin (LOCK) will reliably indicate a
phase–locked condition at SYNC input frequencies down
to 10MHz. At frequencies below 10MHz, the frequency of
correction pulses going into the phase detector form the
SYNC and FEEDBACK pins may not be sufficient to allow
the lock indicator circuitry to accurately predict a
phase–locked conditition. The MC88915T is guaranteed
to provide stable phase–locked operation down to the
appropriate minimum input frequency given in Table 1,
even though the LOCK pin may be LOW at frequencies
below 10MHZ. The exact minimum frequency where the
lock indicator functionality can be guaranteed will be
available when the MC88915T reaches ‘MC’ status.
Q/2 OUTPUT
tCYCLE SYNC INPUT
The MC88915T aligns rising edges of the FEEDBACK input and SYNC input, therefore the SYNC input does
not require a 50% duty cycle.
All skew specs are measured between the VCC/2 crossing point of the appropriate output edges.All skews
are specified as ‘windows’, not as a
±
deviation around a center point.
If a “Q” output is connected to the FEEDBACK input (this situation is not shown), the “Q” output frequency
would match the SYNC input frequency, the 2X_Q output would run at twice the SYNC frequency, and the
Q/2 output would run at half the SYNC frequency.
Timing Notes:
(These waveforms represent the hook–up configuration of Figure 5a on page 16)
FEEDBACK
INPUT
SYNC INPUT
(SYNC[1] or
SYNC[0])
Figure 4. Output/Input Switching Waveforms and Timing Diagrams
tCYCLE “Q” OUTPUTS
2X_Q OUTPUT
Q5 OUTPUT
tSKEWf
tSKEWf
tSKEWR
tSKEWr
tSKEWALL
Q0 – Q4
OUTPUTS
PD
t
相關PDF資料 |
PDF描述 |
|---|---|
| MC88915FN55PLCC | Low Skew CMOS PLL Clock Driver |
| MC88915T | LOW SKEW CMOS PLL CLOCK DRIVER |
| MC88915TFN133 | CONNECTOR ACCESSORY |
| MC88915TFN160 | LOW SKEW CMOS PLL CLOCK DRIVER |
| MC88915TFN55 | CONNECTOR ACCESSORY |
相關代理商/技術參數 |
參數描述 |
|---|---|
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| MC88915TEI100R2 | 功能描述:IC PLL CLOCK DRIVER 28-PLCC RoHS:是 類別:集成電路 (IC) >> 時鐘/計時 - 時鐘發生器，PLL，頻率合成器 系列:- 標準包裝:1,000 系列:- 類型:時鐘/頻率合成器，扇出分配 PLL:- 輸入:- 輸出:- 電路數:- 比率 - 輸入:輸出:- 差分 - 輸入:輸出:- 頻率 - 最大:- 除法器/乘法器:- 電源電壓:- 工作溫度:- 安裝類型:表面貼裝 封裝/外殼:56-VFQFN 裸露焊盤 供應商設備封裝:56-VFQFP-EP（8x8） 包裝:帶卷 (TR) 其它名稱:844S012AKI-01LFT |
| MC88915TEI133 | 功能描述:IC PLL CLOCK DRIVER 28-PLCC RoHS:是 類別:集成電路 (IC) >> 時鐘/計時 - 時鐘發生器，PLL，頻率合成器 系列:- 標準包裝:1,000 系列:- 類型:時鐘/頻率合成器，扇出分配 PLL:- 輸入:- 輸出:- 電路數:- 比率 - 輸入:輸出:- 差分 - 輸入:輸出:- 頻率 - 最大:- 除法器/乘法器:- 電源電壓:- 工作溫度:- 安裝類型:表面貼裝 封裝/外殼:56-VFQFN 裸露焊盤 供應商設備封裝:56-VFQFP-EP（8x8） 包裝:帶卷 (TR) 其它名稱:844S012AKI-01LFT |
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