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參數資料
型號: TMX320TCI6482ZTZA8
廠商: Texas Instruments, Inc.
元件分類: 數字信號處理
英文描述: Communications Infrastructure Digital Signal Processor
中文描述: 通信基礎設施的數字信號處理器
文件頁數: 107/255頁
文件大小: 1893K
代理商: TMX320TCI6482ZTZA8
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www.ti.com
8.4 Enhanced Direct Memory Access (EDMA3) Controller
TMS320TCI6482
Communications Infrastructure Digital Signal Processor
SPRS246F–APRIL 2005–REVISED MAY 2007
The primary purpose of the EDMA3 is to service user-programmed data transfers between two
memory-mapped slave endpoints on the device. The EDMA3 services software-driven paging transfers
(e.g., data movement between external memory and internal memory), performs sorting or subframe
extraction of various data structures, services event driven peripherals such as a McBSP or the UTOPIA
port, and offloads data transfers from the device CPU.
The EDMA3 includes the following features:
Fully orthogonal transfer description
3 transfer dimensions: array (multiple bytes), frame (multiple arrays), and block (multiple frames)
Single event can trigger transfer of array, frame, or entire block
Independent indexes on source and destination
Flexible transfer definition:
Increment or FIFO transfer addressing modes
Linking mechanism allows for ping-pong buffering, circular buffering, and repetitive/continuous
transfers, all with no CPU intervention
Chaining allows multiple transfers to execute with one event
256 PaRAM entries
Used to define transfer context for channels
Each PaRAM entry can be used as a DMA entry, QDMA entry, or link entry
64 DMA channels
Manually triggered (CPU writes to channel controller register), external event triggered, and chain
triggered (completion of one transfer triggers another)
4 Quick DMA (QDMA) channels
Used for software-driven transfers
Triggered upon writing to a single PaRAM set entry
4 transfer controllers/event queues with programmable system-level priority
Interrupt generation for transfer completion and error conditions
Memory protection support
Active memory protection for accesses to PaRAM and registers
Debug visibility
Queue watermarking/threshold allows detection of maximum usage of event queues
Error and status recording to facilitate debug
Each of the transfer controllers has a direct connection to the switched central resource (SCR).
NOTE
Although the transfer controllers are directly connected to the SCR, they can only access
certain device resources. For example, only transfer controller 1 (TC1) can access the
McBSPs.
Table 4-1
lists the device resources that can be accessed by each of the
transfer controllers.
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C64x+ Peripheral Information and Electrical Specifications
107
相關PDF資料
PDF描述
TMX380SRAFNL Communications Interface
TMX70A2400AJDL Modem Controller
TMX99532NL MODEM
TMXF281553BAL-3C-DB Telecomm/Datacomm
TFRA28J133BAL-1 Transient Voltage Suppressor Diodes
相關代理商/技術參數
參數描述
TMX320TCI6616XCYP 制造商:Texas Instruments 功能描述:
TMX320VC33PGE 制造商:Texas Instruments 功能描述:
TMX320VC5401PGE50 制造商:Rochester Electronics LLC 功能描述:- Bulk
TMX320VC5402GGLL100 制造商:Rochester Electronics LLC 功能描述:- Bulk
TMX320VC5402GGU100 制造商:Rochester Electronics LLC 功能描述:- Bulk
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