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參數(shù)資料
| 型號(hào)： | MC68030FE25 |
| 廠商： | MOTOROLA INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | ENHANCED 32-BIT MICROPROCESSOR |
| 中文描述： | 32-BIT, 25 MHz, MICROPROCESSOR, CQFP132 |
| 封裝： | CERAMIC, QFP-132 |
| 文件頁數(shù)： | 208/602頁 |
| 文件大小： | 3863K |
| 代理商： | MC68030FE25 |
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Bus Operation
7-62
MC68030 USER’S MANUAL
MOTOROLA
If the appropriate cache is not enabled or if the cache freeze bit for the cache is set, the
processor does not assert CBREQ. CBREQ is not asserted during the read or write cycles
of any read-modify-write operation.
The MC68030 allows burst filling only from 32-bit ports that terminate bus cycles with
STERM and respond to CBREQ by asserting CBACK. When the MC68030 recognizes
STERM and CBACK and it has asserted CBREQ, it maintains AS, DS, R/W, A0–A31, FC0–
FC2, SIZ0–SIZ1 in their current state throughout the burst operation. The processor
continues to accept data on every clock during which STERM is asserted until the burst is
complete or an abnormal termination occurs.
CBACK indicates that the addressed device can respond to a cache burst request by
supplying one more long word of data in the burst mode. It can be asserted independently
of the CBREQ signal, and burst mode is only initiated if both of these signals are asserted
for a synchronous cycle. If the MC68030 executes a full burst operation and fetches four
long words, CBREQ is negated after STERM is asserted for the third cycle, indicating that
the MC68030 only requests one more long word (the fourth cycle). CBACK can then be
negated, and the MC68030 latches the data for the fourth cycle and completes the cache
line fill.
The following conditions can abort a burst fill:
CIIN asserted,
BERR asserted, or
CBACK negated prematurely.
The processing of a bus error during a burst fill operation is described in
7.5.1 Bus Errors
.
For the purposes of halting the processor or arbitrating the bus away from the processor with
BR, a burst operation is a single cycle since AS remains asserted during the entire
operation. If the HALT signal is asserted during a burst operation, the processor halts at the
end of the operation. Refer to
7.5.3 Halt Operation
for more information about the halt
operation. An alternate bus master requesting the bus with BR may become bus master at
the end of the operation provided BR is asserted early enough to be internally synchronized
before another processor cycle begins. Refer to
7.7 Bus Arbitration
for more information
about bus arbitration.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| MC68030RC20 | ENHANCED 32-BIT MICROPROCESSOR |
| MC68030RC25 | ENHANCED 32-BIT MICROPROCESSOR |
| MC68030RC33 | ENHANCED 32-BIT MICROPROCESSOR |
| MC68030FE20 | ENHANCED 32-BIT MICROPROCESSOR |
| MC68030 | QUad Integrated Communications Controller Users Manual |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| MC68030FE25C | 功能描述:微處理器 - MPU 32B ON-CHIP CACHE MMU RoHS:否 制造商:Atmel 處理器系列:SAMA5D31 核心:ARM Cortex A5 數(shù)據(jù)總線寬度:32 bit 最大時(shí)鐘頻率:536 MHz 程序存儲(chǔ)器大小:32 KB 數(shù)據(jù) RAM 大小:128 KB 接口類型:CAN, Ethernet, LIN, SPI,TWI, UART, USB 工作電源電壓:1.8 V to 3.3 V 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:FBGA-324 |
| MC68030FE33 | 制造商:MOTOROLA 制造商全稱:Motorola, Inc 功能描述:ENHANCED 32-BIT MICROPROCESSOR |
| MC68030FE33C | 功能描述:微處理器 - MPU 32B ON-CHIP CACHE MMU RoHS:否 制造商:Atmel 處理器系列:SAMA5D31 核心:ARM Cortex A5 數(shù)據(jù)總線寬度:32 bit 最大時(shí)鐘頻率:536 MHz 程序存儲(chǔ)器大小:32 KB 數(shù)據(jù) RAM 大小:128 KB 接口類型:CAN, Ethernet, LIN, SPI,TWI, UART, USB 工作電源電壓:1.8 V to 3.3 V 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:FBGA-324 |
| MC68030RC16B | 制造商:Motorola Inc 功能描述:MC68030RC16B |
| MC68030RC16C | 功能描述:微處理器 - MPU 32B ON-CHIP CACHE MMU RoHS:否 制造商:Atmel 處理器系列:SAMA5D31 核心:ARM Cortex A5 數(shù)據(jù)總線寬度:32 bit 最大時(shí)鐘頻率:536 MHz 程序存儲(chǔ)器大小:32 KB 數(shù)據(jù) RAM 大小:128 KB 接口類型:CAN, Ethernet, LIN, SPI,TWI, UART, USB 工作電源電壓:1.8 V to 3.3 V 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:FBGA-324 |
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