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參數資料
| 型號： | MC68030FE25 |
| 廠商： | MOTOROLA INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | ENHANCED 32-BIT MICROPROCESSOR |
| 中文描述： | 32-BIT, 25 MHz, MICROPROCESSOR, CQFP132 |
| 封裝： | CERAMIC, QFP-132 |
| 文件頁數： | 290/602頁 |
| 文件大小： | 3863K |
| 代理商： | MC68030FE25 |
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Memory Management Unit
9-2
MC68030 USER’S MANUAL
MOTOROLA
0-15 Upper Logical Address Bits Can Be Ignored (Using Initial Shift)
Portions of Tables Can Be Undefined (Using Limits)
Write Protection and Supervisor Protection
History Bits Automatically Maintained in Page Descriptors
Cache Inhibit Output (CIOUT) Signal Asserted on Page Basis
External Translation Disable Input Signal (MMUDIS)
Subset of Instruction Set Defined by MC68851
The MMU completely overlaps address translation time with other processing activity when
the translation is resident in the ATC. ATC accesses operate in parallel with the on-chip
instruction and data caches.
Figure 9-1 is a block diagram of the MC68030 showing the relationship of the MMU to the
execution unit and the bus controller. For an instruction or operand access, the MC68030
simultaneously searches the caches and searches for a physical address in the ATC. If the
translation is available, the MMU provides the physical address to the bus controller and
allows the bus cycle to continue. When the instruction or operand is in either of the on-chip
caches on a read cycle, the bus controller aborts the bus cycle before address strobe is
asserted. Similarly, the MMU causes a bus cycle to abort before the assertion of address
strobe when a valid translation is not available in the ATC or when an invalid access is
attempted.
An MMU disable input signal (MMUDIS) is provided that dynamically disables address
translation for emulation, diagnostic, or other purposes.
The programming model of the MMU (see Figure 9-2) consists of two root pointer registers,
a control register, two transparent translation registers, and a status register. These
registers can only be accessed by supervisor programs. The CPU root pointer register
points to an address translation tree structure in memory that describes the logical-to-
physical mapping for user accesses or for both user and supervisor accesses. The
supervisor root pointer register optionally points to an address translation tree structure for
supervisor mappings. The translation control register is comprised of fields that control the
translation operation. Each transparent translation register can define a block of logical
addresses that are used as physical addresses (without translation). The MMU status
register contains accumulated status information from a translation performed as a part of a
PTEST instruction.
相關PDF資料 |
PDF描述 |
|---|---|
| MC68030RC20 | ENHANCED 32-BIT MICROPROCESSOR |
| MC68030RC25 | ENHANCED 32-BIT MICROPROCESSOR |
| MC68030RC33 | ENHANCED 32-BIT MICROPROCESSOR |
| MC68030FE20 | ENHANCED 32-BIT MICROPROCESSOR |
| MC68030 | QUad Integrated Communications Controller Users Manual |
相關代理商/技術參數 |
參數描述 |
|---|---|
| MC68030FE25C | 功能描述:微處理器 - MPU 32B ON-CHIP CACHE MMU RoHS:否 制造商:Atmel 處理器系列:SAMA5D31 核心:ARM Cortex A5 數據總線寬度:32 bit 最大時鐘頻率:536 MHz 程序存儲器大小:32 KB 數據 RAM 大小:128 KB 接口類型:CAN, Ethernet, LIN, SPI,TWI, UART, USB 工作電源電壓:1.8 V to 3.3 V 最大工作溫度:+ 85 C 安裝風格:SMD/SMT 封裝 / 箱體:FBGA-324 |
| MC68030FE33 | 制造商:MOTOROLA 制造商全稱:Motorola, Inc 功能描述:ENHANCED 32-BIT MICROPROCESSOR |
| MC68030FE33C | 功能描述:微處理器 - MPU 32B ON-CHIP CACHE MMU RoHS:否 制造商:Atmel 處理器系列:SAMA5D31 核心:ARM Cortex A5 數據總線寬度:32 bit 最大時鐘頻率:536 MHz 程序存儲器大小:32 KB 數據 RAM 大小:128 KB 接口類型:CAN, Ethernet, LIN, SPI,TWI, UART, USB 工作電源電壓:1.8 V to 3.3 V 最大工作溫度:+ 85 C 安裝風格:SMD/SMT 封裝 / 箱體:FBGA-324 |
| MC68030RC16B | 制造商:Motorola Inc 功能描述:MC68030RC16B |
| MC68030RC16C | 功能描述:微處理器 - MPU 32B ON-CHIP CACHE MMU RoHS:否 制造商:Atmel 處理器系列:SAMA5D31 核心:ARM Cortex A5 數據總線寬度:32 bit 最大時鐘頻率:536 MHz 程序存儲器大小:32 KB 數據 RAM 大小:128 KB 接口類型:CAN, Ethernet, LIN, SPI,TWI, UART, USB 工作電源電壓:1.8 V to 3.3 V 最大工作溫度:+ 85 C 安裝風格:SMD/SMT 封裝 / 箱體:FBGA-324 |
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