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參數資料
| 型號： | MC68MH360FE33 |
| 廠商： | MOTOROLA INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | QUad Integrated Communications Controller Users Manual |
| 中文描述： | 32-BIT, 33 MHz, RISC MICROCONTROLLER, CQFP240 |
| 封裝： | CERAMIC, QFP-240 |
| 文件頁數： | 524/962頁 |
| 文件大小： | 2817K |
| 代理商： | MC68MH360FE33 |
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Serial Communication Controllers (SCCs)
7-200
MC68360 USER’S MANUAL
MOTOROLA
7.10.19.4.2 PSMR Programming.
The PSMR programming sequence is as follows:
1. The NOF bits should be set to 0001 (binary) giving two flags before frames (one open-
ing flag, plus one additional flag).
2. The CRC should be set to 16-bit CRC-CCITT.
3. The DRT bit should be set.
4. All other bits should be set to zero or to their default condition.
7.10.19.4.3 TODR Programming.
To expedite a transmit frame, the transmit on demand
register (TODR) may be used.
7.10.19.4.4 AppleTalk Controller Example.
Except for the previously discussed register
programming, the HDLC Example #1 may be followed.
7.10.20 BISYNC Controller
The byte-oriented binary synchronous communication (BISYNC) protocol was originated by
IBM for use in networking products. The three classes of BISYNC frames are transparent,
non-transparent with header, and non-transparent without header (see Figure 7-63). The
transparent mode in BISYNC allows full binary data to be transmitted with any possible char-
acter pattern. Each class of frame starts with a standard two-octet synchronization pattern
and ends with a block check code (BCC). The end of text character (ETX) is used to sepa-
rate the text and BCC fields.
NOTE
The transparent frame type in BISYNC is not related to the total-
ly transparent protocol supported by the QUICC. See 7.10.21
Transparent Controller for details.
Figure 7-63. Typical BISYNC Frames
The bulk of the frame is divided into fields whose meaning depends on the frame type. The
BCC is a 16-bit CRC (CRC16) format if 8-bit characters are used; it is a longitudinal check
(a sum check) in combination with vertical redundancy check (parity) if 7-bit characters are
used. In transparent operation, to allow the BISYNC control characters to be present in the
frame as valid text data, a special character (DLE) is defined, which informs the receiver that
the character following the DLE is a text character, not a control character. If a DLE is trans-
mitted as valid data, it must be preceded by a DLE character. This technique is sometimes
called byte-stuffing.
NON-TRANSPARENT WITH HEADER
SYN1
SYN2
SOH
HEADER
STX
TEXT
ETX
BCC
NON-TRANSPARENT WITHOUT HEADER
SYN1
SYN2
STX
TEXT
ETX
BCC
TRANSPARENT
SYN1
SYN2
DLE
STX
TRANSPARENT TEXT
DLE
ETX
BCC
相關PDF資料 |
PDF描述 |
|---|---|
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| MC68HRC08JK1 | HCMOS Microcontroller Unit |
相關代理商/技術參數 |
參數描述 |
|---|---|
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| MC68MH360RC25L | 功能描述:微處理器 - MPU QUICC 2SMC 1SPI RoHS:否 制造商:Atmel 處理器系列:SAMA5D31 核心:ARM Cortex A5 數據總線寬度:32 bit 最大時鐘頻率:536 MHz 程序存儲器大小:32 KB 數據 RAM 大小:128 KB 接口類型:CAN, Ethernet, LIN, SPI,TWI, UART, USB 工作電源電壓:1.8 V to 3.3 V 最大工作溫度:+ 85 C 安裝風格:SMD/SMT 封裝 / 箱體:FBGA-324 |
| MC68MH360RC33L | 功能描述:微處理器 - MPU QUICC 2SMC 1SPI RoHS:否 制造商:Atmel 處理器系列:SAMA5D31 核心:ARM Cortex A5 數據總線寬度:32 bit 最大時鐘頻率:536 MHz 程序存儲器大小:32 KB 數據 RAM 大小:128 KB 接口類型:CAN, Ethernet, LIN, SPI,TWI, UART, USB 工作電源電壓:1.8 V to 3.3 V 最大工作溫度:+ 85 C 安裝風格:SMD/SMT 封裝 / 箱體:FBGA-324 |
| MC68MH360VR25L | 功能描述:微處理器 - MPU QUICC 2SMC 1SPI RoHS:否 制造商:Atmel 處理器系列:SAMA5D31 核心:ARM Cortex A5 數據總線寬度:32 bit 最大時鐘頻率:536 MHz 程序存儲器大小:32 KB 數據 RAM 大小:128 KB 接口類型:CAN, Ethernet, LIN, SPI,TWI, UART, USB 工作電源電壓:1.8 V to 3.3 V 最大工作溫度:+ 85 C 安裝風格:SMD/SMT 封裝 / 箱體:FBGA-324 |
| MC68MH360VR25LR2 | 功能描述:微處理器 - MPU QUICC 2SMC 1SPI RoHS:否 制造商:Atmel 處理器系列:SAMA5D31 核心:ARM Cortex A5 數據總線寬度:32 bit 最大時鐘頻率:536 MHz 程序存儲器大小:32 KB 數據 RAM 大小:128 KB 接口類型:CAN, Ethernet, LIN, SPI,TWI, UART, USB 工作電源電壓:1.8 V to 3.3 V 最大工作溫度:+ 85 C 安裝風格:SMD/SMT 封裝 / 箱體:FBGA-324 |
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