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參數(shù)資料
| 型號： | MC68MH360FE33 |
| 廠商： | MOTOROLA INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | QUad Integrated Communications Controller Users Manual |
| 中文描述： | 32-BIT, 33 MHz, RISC MICROCONTROLLER, CQFP240 |
| 封裝： | CERAMIC, QFP-240 |
| 文件頁數(shù)： | 6/962頁 |
| 文件大小： | 2817K |
| 代理商： | MC68MH360FE33 |
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Table of Contents
Paragraph
Number
2.1.7.5
2.1.7.6
2.1.7.7
2.1.7.8
2.1.8
2.1.8.1
2.1.8.2
2.1.8.3
2.1.8.4
2.1.8.5
RO/CONFIG1/RAS2DD).2-9
2.1.9
System Control Signals..........................................................................2-10
2.1.9.1
Soft Reset (RESETS). ...........................................................................2-10
2.1.9.2
Hard Reset (RESETH)...........................................................................2-10
2.1.9.3
Halt (HALT)............................................................................................2-10
2.1.9.4
Bus Error (BERR). .................................................................................2-10
2.1.10
Clock Signals.........................................................................................2-10
2.1.10.1
System Clock Outputs (CLKO2–CLKO1). .............................................2-10
2.1.10.2
Crystal Oscillator (EXTAL, XTAL)..........................................................2-11
2.1.10.3
External Filter Capacitor (XFC)..............................................................2-11
2.1.10.4
Clock Mode Select (MODCK1–MODCK0).............................................2-11
2.1.11
Instrumentation and Emulation Signals .................................................2-11
2.1.11.1
Instruction Fetch/Development Serial Input (IFETCH/DSI)....................2-11
2.1.11.2
Instruction Pipe/Development Serial Output (
2.1.11.3
Instruction Pipe/Row Address Select Double-Drive (
2.1.11.4
Breakpoint/Development Serial clock (BKPT/DSCLK). .........................2-11
2.1.11.5
Freeze/Initial Configuration (FREEZE/CONFIG2). ................................2-12
2.1.12
Test Signals...........................................................................................2-12
2.1.12.1
TRI-State Signal (TRIS).........................................................................2-12
2.1.12.2
Test Reset (TRST).................................................................................2-12
2.1.12.3
Test Clock (TCK). ..................................................................................2-12
2.1.12.4
Test Mode Select (TMS)........................................................................2-12
2.1.12.5
Test Data In (TDI)..................................................................................2-12
2.1.12.6
Test Data Out (TDO)..............................................................................2-12
2.1.13
Initial Configuration Pins (CONFIG).......................................................2-12
2.1.14
Power Signals........................................................................................2-13
2.1.14.1
VCCSYN and GNDSYN.........................................................................2-13
2.1.14.2
VCCCLK and GNDCLK. ........................................................................2-13
2.1.14.3
GNDS1 and GNDS2..............................................................................2-13
2.1.14.4
VCC and GND. ......................................................................................2-13
2.1.14.5
NC4–NC1...............................................................................................2-13
2.2
System Bus Signal Index in Slave Mode...............................................2-14
2.3
On-Chip Peripherals Signal Index..........................................................2-15
Title
Page
Number
ii
MC68360 USER’S MANUAL
MOTOROLA
Transfer Size (SIZ1, SIZ0).......................................................................2-8
Read/Write (R/W).....................................................................................2-8
Output Enable/Address Multiplex (OE/AMUX).........................................2-9
Byte Write Enable (WE3–WE0)...............................................................2-9
Bus Arbitration Signals.............................................................................2-9
Bus Request (BR)....................................................................................2-9
Bus Grant (BG)........................................................................................2-9
Bus Grant Acknowledge (BGACK). .........................................................2-9
Read-Modify-Write Cycle/Initial Configuration (RMC/CONFIG0).............2-9
Bus Clear Out/Initial Configuration/Row Address Select Double-Drive (BCL-
IPIPE0/DSO
)...................2-11
IPIPE1/RAS1DD
).2-11
Section 3
相關(guān)PDF資料 |
PDF描述 |
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