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參數(shù)資料
| 型號： | MC68MH360RC33 |
| 廠商： | MOTOROLA INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | QUad Integrated Communications Controller Users Manual |
| 中文描述： | 32-BIT, 33 MHz, RISC MICROCONTROLLER, CPGA241 |
| 封裝： | PGA-241 |
| 文件頁數(shù)： | 12/962頁 |
| 文件大小： | 2817K |
| 代理商： | MC68MH360RC33 |
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Table of Contents
Paragraph
Number
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6.9.3.4
6.9.3.5
6.9.3.6
Title
Page
Number
viii
MC68360 USER’S MANUAL
MOTOROLA
SIM60 System Clock Generation...........................................................6-12
Clock Generation Methods ....................................................................6-12
Oscillator Prescaler (Divide by 128).......................................................6-13
Phase-Locked Loop (PLL).....................................................................6-14
Frequency Multiplication........................................................................6-14
Skew Elimination....................................................................................6-15
Low-Power Divider.................................................................................6-15
QUICC Internal Clock Signals................................................................6-15
SPCLK...................................................................................................6-16
General System Clock...........................................................................6-16
BRGCLK................................................................................................6-17
SyncCLK................................................................................................6-17
SIMCLK..................................................................................................6-18
CLKO1...................................................................................................6-18
CLKO2...................................................................................................6-18
PLL Power Pins .....................................................................................6-19
VCCSYN................................................................................................6-19
GNDSYN................................................................................................6-19
XFC........................................................................................................6-19
CLKO Power Pins..................................................................................6-19
VCCCLK ................................................................................................6-19
GNDCLK................................................................................................6-19
Configuration Pins (MODCK1–MODCK0) .............................................6-19
Breakpoint Logic....................................................................................6-20
External Bus Interface Control...............................................................6-21
Initial Configuration................................................................................6-22
Port D.....................................................................................................6-22
Port E.....................................................................................................6-23
Slave (Disable CPU32+) Mode..............................................................6-23
MBAR in a Multiple QUICC System.......................................................6-24
Global Chip Select (CS0) in Slave Mode...............................................6-25
Bus Clear in Slave Mode .......................................................................6-25
Interrupts in Slave Mode........................................................................6-26
Pin Differences in Slave Mode...............................................................6-26
Other Functionality in Slave Mode.........................................................6-27
Programmer’s Model..............................................................................6-27
Module Base Address Register (MBAR)................................................6-27
Module Base Address Register Enable (MBARE).................................6-29
System Configuration and Protection Registers....................................6-29
Module Configuration Register (MCR)...................................................6-29
Autovector Register (AVR).....................................................................6-34
Reset Status Register (RSR).................................................................6-34
Software Watchdog Interrupt Vector Register (SWIV)...........................6-35
System Protection Control Register (SYPCR).......................................6-35
Periodic Interrupt Control Register (PICR).............................................6-37
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