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參數資料
| 型號： | MC68MH360RC33 |
| 廠商： | MOTOROLA INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | QUad Integrated Communications Controller Users Manual |
| 中文描述： | 32-BIT, 33 MHz, RISC MICROCONTROLLER, CPGA241 |
| 封裝： | PGA-241 |
| 文件頁數： | 241/962頁 |
| 文件大小： | 2817K |
| 代理商： | MC68MH360RC33 |
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CPU32+
MOTOROLA
MC68360 USER’S MANUAL
5-99
5.7.2.12 CONTROL INSTRUCTIONS.
The control instruction table indicates the number of
clock periods needed for the processor to perform the specified operation on the given
addressing mode. Footnotes indicate when to account for the appropriate EA times. The
total number of clock cycles is outside the parentheses. The numbers inside parentheses (r/
p/w) are included in the total clock cycle number. All timing data assumes two-clock reads
and writes.
Instruction
Head
Tail
Cycles
ANDI
#, SR
0
2
2
2
12(0/2/0)
EORI
#, SR
0
12(0/2/0)
ORI
#, SR
0
12(0/2/0)
ANDI
#, CCR
2
0
6(0/2/0)
EORI
#, CCR
2
0
6(0/2/0)
ORI
#, CCR
2
0
6(0/2/0)
BSR.B
3
2
2
2
13(0/2/2)
BSR.W
3
13(0/2/2)
BSR.L
1
13(0/2/2)
CHK
FEA
, Dn (no ex)
FEA
, Dn (ex)
2
0
8(0/1/0)
CHK
2
2
42(2/2/6)
CHK2 (Save)
FEA
, Dn (no ex)
CHK2 (Op)
FEA
, Dn (no ex)
CHK2 (Save)
FEA
, Dn (ex)
CHK2 (Op)
FEA
, Dn (ex)
CEA
CEA
CEA
, An
1
1
3(0/1/0)
2
0
18(X/0/0)
1
1
3(0/1/0)
2
2
2
2
52(X
+
2/1/6)
JMP
0
6(0/2/0)
JSR
3
13(0/2/2)
LEA
0
0
2(0/1/0)
LINK.W An, #
2
0
10(0/2/2)
LINK.L
An, #
0
0
10(0/3/2)
NOP
0
0
2(0/1/0)
PEA
CEA
0
0
8(0/1/2)
RTD
#
1
2
2
2
12(2/2/0)
RTR
1
14(3/2/0)
RTS
1
12(2/2/0)
UNLK
An
1
0
9(2/1/0)
X
=
There is one bus cycle for byte and word operands and two bus cycles for long-word
operands. For long-word bus cycles, add two clocks to the tail and to the number of
cycles.
Timing is calculated with the CPU32+ in 16-bit mode.
NOTE:
culate thThe CHK2 instruction involves a save step that other instructions do not have. To cal-
then combine in the order listed using the equations given in 5.7.1 Resource Scheduling.
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PDF描述 |
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