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參數資料
| 型號： | MC68MH360RC33 |
| 廠商： | MOTOROLA INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | QUad Integrated Communications Controller Users Manual |
| 中文描述： | 32-BIT, 33 MHz, RISC MICROCONTROLLER, CPGA241 |
| 封裝： | PGA-241 |
| 文件頁數： | 523/962頁 |
| 文件大小： | 2817K |
| 代理商： | MC68MH360RC33 |
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Serial Communication Controllers (SCCs)
MOTOROLA
MC68360 USER’S MANUAL
7-199
Figure 7-62. Connecting the QUICC to LocalTalk
7.10.19.4.1 GSMR Programming.
The GSMR programming sequence is as follows:
1. The MODE bits should be set to AppleTalk.
2. The ENT and ENR bits should be set.
3. The DIG bits should be set for normal operation, with the CD and CTS pins
grounded or with the CD and CTS pins configured for parallel I/O, which causes
CD and CTS to be internally asserted to the SCC.
4. The RDCR and TDCR bits should usually be set to 16x clock.
5. The TENC and RENC bits should be set for FM0.
6. The Tend bit should be zero.
7. The TPP bits should be 11.
8. The TPL bits should be set to 000 to transmit the next frame with no
synchronization sequence and to 001 to transmit the next frame with
the LocalTalk synchronization sequence. For example, data frames do
not require a preceding synchronization sequence. These bits may be
modified on the fly if the AppleTalk protocol is selected.
9. The TINV and RINV bits should be zero.
10.The TSNC bits should be set to 1.5 bit times 10.
11.The EDGE bits should be zero.
12.RTSM should be zero.
13.All other bits should be set to zero or to their default condition.
QUICC
RS-422
MINI-DIN 8
SCC
TXD
RTS
RXD
Tx DATA
Rx DATA
TX ENABLE
16 ONES
(ABORT)
CRC-16
STORED IN TRANSMIT BUFFER
STORED IN RECEIVE BUFFER
RTS
TXD
DEST.
ADDR.
SOURCE
ADDR.
CONTROL
BYTE
DATA
STANDARD HDLC FRAME HANDLING
6-BIT
SYNC
SEQ
TWO
HDLC
FLAGS
CLOSING
FLAG
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PDF描述 |
|---|---|
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參數描述 |
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