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參數(shù)資料
| 型號： | W90221F |
| 廠商： | WINBOND ELECTRONICS CORP |
| 英文描述： | PA-RISC Embedded Micro-Controller(惠普PA-RISC結構的32位嵌入式微控制器) |
| 中文描述： | PA - RISC的嵌入式微控制器（惠普的PA - RISC結構的32位嵌入式微控制器） |
| 文件頁數(shù)： | 126/174頁 |
| 文件大小： | 2102K |
| 代理商： | W90221F |
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=
The above information is the exclusive intellectual property of Winbond Electronics and shall not be disclosed, distributed or reproduced without permission from Winbond.
126
Versi on 0. 4, March/2000
Bits 7 CTS# state change
This bit is set whenever CTS# input has changed state, and it will be reset if the CPU reads
the MSR.
Whenever either of MSR[4:7] is set to logic 1, a Modem Status Interrupt is generated if IER[4]=1.
Writing LSR is a null operation (not suggested).
Time Out Register (TOR)
Port address : 0xf00003ff (COM0)
0xf00002ff (COM1)
Read/Write
Power-on Default : 0x0
0
1
2
3
4
5
6
7
TOUT_en
TOUT_cmp
Bits 0 Time-Out (interrupt) enable
The feature of Receiver Time-Out (interrupt) is enable only when TOR[0] = IER[7] = 1.
Bits 1-7 Time-Out (interrupt) comparator
The Time-Out counter is reset and start counting (the counting clock = baud rate) whenever
the RX FIFO receives a new data word. Once the content of Time-Out counter (TOUT_cnt)
is equal to that of Time-Out comparator (TOUT_cmp), a Receiver Time-Out interrupt Irpt_
TOUT) is generated if TOR[0] = IER[7] = 1.
A new incoming data word or RX FIFO empty clears Irpt_TOUT.
6.8 SYNCHRONOUS SERIAL INTERFACE REGISTERS
There are five registers included in the Synchronous Serial Interface (SSI) controller. The IO address map is
allocated from 0xf0000380 to 0xf000038a.
Table 6.8-1 : SSI Register Map
(IO base (BA) : 0xf0000000)
相關PDF資料 |
PDF描述 |
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參數(shù)描述 |
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