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參數(shù)資料
| 型號： | MC68EN360FE25V |
| 廠商： | MOTOROLA INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | QUad Integrated Communications Controller Users Manual |
| 中文描述： | 32-BIT, 25 MHz, RISC MICROCONTROLLER, CQFP240 |
| 封裝： | CERAMIC, QFP-240 |
| 文件頁數(shù)： | 239/962頁 |
| 文件大?。?/td> | 2817K |
| 代理商： | MC68EN360FE25V |
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CPU32+
MOTOROLA
MC68360 USER’S MANUAL
5-97
ber of clock cycles is outside the parentheses. The numbers inside parentheses (r/p/w) are
included in the total clock cycle number. All timing data assumes two-clock reads and writes.
5.7.2.10 BIT MANIPULATION INSTRUCTIONS.
The bit manipulation instruction table indi-
cates the number of clock periods needed for the processor to perform the specified opera-
tion on the given addressing mode. The total number of clock cycles is outside the
parentheses. The numbers inside parentheses (r/p/w) are included in the total clock cycle
number. All timing data assumes two-clock reads and writes.
Instruction
Head
Tail
Cycles
Note
LSd
Dn, Dm
2
0
(0/1/0)
1
LSd
#, Dm
4
0
6(0/1/0)
—
LSd
FEA
0
2
6(0/1/1)
—
ASd
Dn, Dm
2
0
(0/1/0)
1
ASd
#, Dm
4
0
6(0/1/0)
—
ASd
FEA
0
2
6(0/1/1)
—
ROd
Dn, Dm
2
0
(0/1/0)
1
ROd
#, Dm
4
0
6(0/1/0)
—
ROd
FEA
0
2
6(0/1/1)
—
ROXd
Dn, Dm
2
2
0
(0/1/0)
2
ROXd
#, Dm
0
(0/1/0)
3
ROXd
FEA
0
2
6(0/1/1)
—
d = Direction (left or right)
NOTES:
1. Head and cycle times can be derived from the following table or calculated as follows:
Max (3
+
(n/4)
+
mod(n,4)
+
mod (((n/4)
+
mod (n,4)
+
1,2), 6)
2. Head and cycle times are calculated as follows: (count
≤
63): max (3
+
n
+
mod (n
+
1,2), 6).
3. Head and cycle times are calculated as follows: (count
≤
8): max (2
+
n
+
mod (n,2), 6).
4. Timing is calculated with the CPU32+ in 16-bit mode.
Clocks
Shift Counts
6
0
1
2
3
4
5
6
8
9
12
8
7
10
11
13
14
16
17
20
10
15
18
19
21
22
24
25
28
12
23
26
27
29
30
32
33
36
14
31
34
35
37
38
40
41
44
16
39
42
43
45
46
48
49
52
18
47
50
51
53
54
56
57
60
20
55
58
59
61
62
22
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