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參數資料
| 型號： | MC68EN360FE25V |
| 廠商： | MOTOROLA INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | QUad Integrated Communications Controller Users Manual |
| 中文描述： | 32-BIT, 25 MHz, RISC MICROCONTROLLER, CQFP240 |
| 封裝： | CERAMIC, QFP-240 |
| 文件頁數： | 534/962頁 |
| 文件大小： | 2817K |
| 代理商： | MC68EN360FE25V |
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Serial Communication Controllers (SCCs)
7-210
MC68360 USER’S MANUAL
MOTOROLA
register refers to the PSMR of the SCC when that SCC is configured for BISYNC mode. This
register is cleared at reset. Some of the PSMR bits can be modified on the fly (i.e., while the
receiver and transmitter are enabled).
NOS—Minimum Number of SYNCs Between or Before Messages
If NOS3–NOS0 = 0000, then 1 SYN1–SYN2 pair will be transmitted; if NOS3–NOS0 =
1111, then 16 SYN1–SYN2 pairs will be transmitted. The SYN1–SYN2 pair is defined in
the DSR. The entire SYN1–SYN2 pair will always be transmitted regardless of the setting
of the SYNL bits in the GSMR. The NOS bits may be modified on the fly.
CRC—CRC Selection
00 = Reserved.
01 = CRC16 (BISYNC). (X16 + X15 + X2 + 1). The PRCRC and PTCRC registers
should be initialized to a preset value of all zeros or all ones before the channel is
enabled. In both cases, the transmitter sends the calculated CRC non-inverted,
and the receiver checks the CRC against zero. Eight-bit data characters (without
parity) are configured when CRC16 is chosen.
10 = Reserved
11 = LRC (sum check). (BISYNC). For even LRC, the PRCRC and PTCRC registers
should be initialized to zero before the channel is enabled. For odd LRC, the PR-
CRC and PTCRC registers should be initialized to ones.
The receiver will check character parity when BCS is programmed to LRC and the
receiver is not in transparent mode. The transmitter will transmit character parity
when BCS is programmed to LRC and the transmitter is not in transparent mode.
Use of parity in BISYNC assumes the use of 7-bit data characters.
RBCS—Receive Block Check Sequence
The BISYNC receiver internally stores two BCS calculations with a byte delay (eight serial
clocks) between them. This enables the user to examine a received data byte and then
decide whether or not it should be part of the BCS calculation. This is useful when control
character recognition and stripping are to be performed in software. The bit should be set
(or reset) within the time taken to receive the following data byte. When this bit is reset,
the BCS calculations exclude the latest fully received data byte. When RBCS is set, the
BCS calculations continue normally.
0 = Disable receive BCS
1 = Enable receive BCS
RTR—Receiver Transparent Mode
0 = The receiver is placed in normal mode with SYNC stripping and control character
recognition operative.
1 = The receiver is placed in transparent mode. SYNCs, DLEs, and control characters
are only recognized after a leading DLE character. The receiver will calculate the
CRC16 sequence, even if it is programmed to LRC while in transparent mode. PR-
CRC should be initialized to the CRC16 preset value before setting this bit.
15
14
13
12
11
10
9
8
7
6
5
4
3
2
1
0
NOS
CRC
RBCS
RTR
RVD
DRT
—
RPM
TPM
相關PDF資料 |
PDF描述 |
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相關代理商/技術參數 |
參數描述 |
|---|---|
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| MC68EN360FS25C | 制造商:Motorola 功能描述:68EN360 S2C4B |
| MC68EN360RC25 | 制造商:MOTOROLA 制造商全稱:Motorola, Inc 功能描述:QUad Integrated Communications Controller Users Manual |
| MC68EN360RC25C | 制造商:Motorola Inc 功能描述: |
| MC68EN360RC25L | 功能描述:微處理器 - MPU QUICC ETHRN RoHS:否 制造商:Atmel 處理器系列:SAMA5D31 核心:ARM Cortex A5 數據總線寬度:32 bit 最大時鐘頻率:536 MHz 程序存儲器大小:32 KB 數據 RAM 大小:128 KB 接口類型:CAN, Ethernet, LIN, SPI,TWI, UART, USB 工作電源電壓:1.8 V to 3.3 V 最大工作溫度:+ 85 C 安裝風格:SMD/SMT 封裝 / 箱體:FBGA-324 |
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