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參數資料
| 型號： | MC68EN360FE25V |
| 廠商： | MOTOROLA INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | QUad Integrated Communications Controller Users Manual |
| 中文描述： | 32-BIT, 25 MHz, RISC MICROCONTROLLER, CQFP240 |
| 封裝： | CERAMIC, QFP-240 |
| 文件頁數： | 570/962頁 |
| 文件大小： | 2817K |
| 代理商： | MC68EN360FE25V |
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Serial Communication Controllers (SCCs)
7-246
MC68360 USER’S MANUAL
MOTOROLA
Figure 7-69. QUICC Ethernet Parallel CAM Interface
;
7.10.23.8 ETHERNET MEMORY MAP.
When configured to operate in Ethernet mode, the
QUICC overlays the structure described in Table 7-5 onto the protocol-specific area of the
SCC parameter RAM described in Table 7-11.
QUICC
SCC
TxD
TENA (RTS)
TCLK (CLKx)
RxD
RENA (CD)
RCLK (CLKx)
CLSN (CTS)
RSTRT
RRJCT
PARALLEL I/O
TX
TENA
TCLK
RX
RENA
RCLK
CLSN
LOOP
P
EEST
MC68160
TO MEDIA
CAMCONTROL
CAM
NOTE: The receive data is sent to the CAM as it is written to system memory. The SDACK2–SDACK1 signals are used to identify the
destination address and any other frame bytes desired. The RSTRT signal is not required in this configuration, although
it is still available.
SYSTEMBUS
SDACK2–SDACK1
DATA
46–1500 BYTES
DEST.
ADDR.
SOURCE
ADDR.
4 BYTES
2 BYTES
6 BYTES
SDACK2
SDACK1
RRJCT
FRAME CAN BE REJECTED IF ASSERTED
DURING FRAME RECEPTION. FURTHER
TRANSMISSIONS ON SYSTEMBUS CEASE,
AND BUFFER DESCRIPTORS ARE REUSED.
SDACK1 ASSERTED WHEN NEW FRAME
ARRIVES.
SDMA
BUS
WRITES
DEST.
ADDR.
2 BYTES
SIGNIFIES
LAST 32-BIT BUS WRITE
TO MEMORY ONLY IF TAG
BYTE IS APPENDED. TAG
BYTE COULD BE BYTE 0, 1, 2,
OR 3 OF THE 32-BIT WRITE.
ASSERTED FOR ONE
CYCLE OR TWO
16-BIT BUS WRITE
CYCLES, ETC.
PB15–PB8
OPTIONAL
FRAME TAG
BYTE
TAG
1 BYTE
(OPTIONAL)
ASSERTED ON EACH
WRITE CYCLE TO
MEMORY UP TO AND
INCLUDING THE
LAST SYSTEMBUS
WRITE OF THE
FRAME
NOTE: The diagram shows SDMA system bus writes, not data on the RXD pin. Other bus activity may occur between successive
32-bit writes. In such a case, the SDACK2–1 pins would not be asserted for other bus activity.
TYPE/
LENGTH
FRAME
CHECK
SEQUENCE
4 BY
相關PDF資料 |
PDF描述 |
|---|---|
| MC68EN360FE33 | QUad Integrated Communications Controller Users Manual |
| MC68EN360RC25 | QUad Integrated Communications Controller Users Manual |
| MC68MH360FE25 | QUad Integrated Communications Controller Users Manual |
| MC68EN360RC33 | AC 4C 4#12 SKT PLUG 025 |
| MC68EN360ZP25 | QUad Integrated Communications Controller Users Manual |
相關代理商/技術參數 |
參數描述 |
|---|---|
| MC68EN360FE33 | 制造商:MOTOROLA 制造商全稱:Motorola, Inc 功能描述:QUad Integrated Communications Controller Users Manual |
| MC68EN360FS25C | 制造商:Motorola 功能描述:68EN360 S2C4B |
| MC68EN360RC25 | 制造商:MOTOROLA 制造商全稱:Motorola, Inc 功能描述:QUad Integrated Communications Controller Users Manual |
| MC68EN360RC25C | 制造商:Motorola Inc 功能描述: |
| MC68EN360RC25L | 功能描述:微處理器 - MPU QUICC ETHRN RoHS:否 制造商:Atmel 處理器系列:SAMA5D31 核心:ARM Cortex A5 數據總線寬度:32 bit 最大時鐘頻率:536 MHz 程序存儲器大小:32 KB 數據 RAM 大小:128 KB 接口類型:CAN, Ethernet, LIN, SPI,TWI, UART, USB 工作電源電壓:1.8 V to 3.3 V 最大工作溫度:+ 85 C 安裝風格:SMD/SMT 封裝 / 箱體:FBGA-324 |
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