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參數資料
| 型號： | AGL250V2-FG144I |
| 廠商： | Microsemi SoC |
| 文件頁數： | 179/250頁 |
| 文件大小： | 0K |
| 描述： | IC FPGA 1KB FLASH 250K 144FBGA |
| 標準包裝： | 160 |
| 系列： | IGLOO |
| 邏輯元件/單元數： | 6144 |
| RAM 位總計： | 36864 |
| 輸入/輸出數： | 97 |
| 門數： | 250000 |
| 電源電壓： | 1.14 V ~ 1.575 V |
| 安裝類型： | 表面貼裝 |
| 工作溫度： | -40°C ~ 85°C |
| 封裝/外殼： | 144-LBGA |
| 供應商設備封裝： | 144-FPBGA（13x13） |
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IGLOO DC and Switching Characteristics
2-18
Revision 23
Combinatorial Cells Contribution—PC-CELL
PC-CELL = NC-CELL* 1 / 2 * PAC7 * FCLK
NC-CELL is the number of VersaTiles used as combinatorial modules in the design.
1 is the toggle rate of VersaTile outputs—guidelines are provided in Table 2-23 on
FCLK is the global clock signal frequency.
Routing Net Contribution—PNET
PNET = (NS-CELL + NC-CELL) * 1 / 2 * PAC8 * FCLK
NS-CELL is the number of VersaTiles used as sequential modules in the design.
NC-CELL is the number of VersaTiles used as combinatorial modules in the design.
1 is the toggle rate of VersaTile outputs—guidelines are provided in Table 2-23 on
FCLK is the global clock signal frequency.
I/O Input Buffer Contribution—PINPUTS
PINPUTS = NINPUTS * 2 / 2 * PAC9 * FCLK
NINPUTS is the number of I/O input buffers used in the design.
2 is the I/O buffer toggle rate—guidelines are provided in Table 2-23 on page 2-19.
FCLK is the global clock signal frequency.
I/O Output Buffer Contribution—POUTPUTS
POUTPUTS = NOUTPUTS * 2 / 2 * 1 * PAC10 * FCLK
NOUTPUTS is the number of I/O output buffers used in the design.
2 is the I/O buffer toggle rate—guidelines are provided in Table 2-23 on page 2-19.
1 is the I/O buffer enable rate—guidelines are provided in Table 2-24 on page 2-19.
FCLK is the global clock signal frequency.
RAM Contribution—PMEMORY
PMEMORY = PAC11 * NBLOCKS * FREAD-CLOCK * 2 + PAC12 * NBLOCK * FWRITE-CLOCK * 3
NBLOCKS is the number of RAM blocks used in the design.
FREAD-CLOCK is the memory read clock frequency.
2 is the RAM enable rate for read operations.
FWRITE-CLOCK is the memory write clock frequency.
3 is the RAM enable rate for write operations—guidelines are provided in Table 2-24 on
PLL Contribution—PPLL
PPLL = PDC4 + PAC13 *FCLKOUT
FCLKOUT is the output clock frequency.
If a PLL is used to generate more than one output clock, include each output clock in the formula by adding its corresponding
contribution (PAC13* FCLKOUT product) to the total PLL contribution.
相關PDF資料 |
PDF描述 |
|---|---|
| VI-J3P-CW | CONVERTER MOD DC/DC 13.8V 100W |
| ADM1026JSTZ-R7 | IC CTRLR SYS REF/EEPROM 48LQFP |
| EBC08DRXN-S734 | CONN EDGECARD 16POS DIP .100 SLD |
| F950J107MSAAM1Q2 | CAP TANT 100UF 6.3V 20% 1206 |
| AIML-0603-R82K-T | INDUCTOR MULTILAYER 820NH 0603 |
相關代理商/技術參數 |
參數描述 |
|---|---|
| AGL250V2-FG144T | 制造商:Microsemi Corporation 功能描述:AGL250V2-FG144T - Trays 制造商:Microsemi Corporation 功能描述:IC FPGA 250K GATES 144FBGA |
| AGL250V2-FGG144 | 功能描述:IC FPGA IGLOO 1.2-1.5V 144FPBGA RoHS:是 類別:集成電路 (IC) >> 嵌入式 - FPGA（現場可編程門陣列） 系列:IGLOO 標準包裝:60 系列:XP LAB/CLB數:- 邏輯元件/單元數:10000 RAM 位總計:221184 輸入/輸出數:244 門數:- 電源電壓:1.71 V ~ 3.465 V 安裝類型:表面貼裝 工作溫度:0°C ~ 85°C 封裝/外殼:388-BBGA 供應商設備封裝:388-FPBGA（23x23） 其它名稱:220-1241 |
| AGL250V2-FGG144I | 功能描述:IC FPGA 1KB FLASH 250K 144FBGA RoHS:是 類別:集成電路 (IC) >> 嵌入式 - FPGA（現場可編程門陣列） 系列:IGLOO 標準包裝:152 系列:IGLOO PLUS LAB/CLB數:- 邏輯元件/單元數:792 RAM 位總計:- 輸入/輸出數:120 門數:30000 電源電壓:1.14 V ~ 1.575 V 安裝類型:表面貼裝 工作溫度:-40°C ~ 85°C 封裝/外殼:289-TFBGA，CSBGA 供應商設備封裝:289-CSP（14x14） |
| AGL250V2-FGG144T | 制造商:Microsemi Corporation 功能描述:AGL250V2-FGG144T - Trays 制造商:Microsemi Corporation 功能描述:IC FPGA 97 I/O 144FBGA |
| AGL250V2-FQN144 | 制造商:ACTEL 制造商全稱:Actel Corporation 功能描述:IGLOO Low-Power Flash FPGAs with Flash Freeze Technology |
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