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參數(shù)資料
| 型號(hào)： | AGL250V2-FG144I |
| 廠商： | Microsemi SoC |
| 文件頁(yè)數(shù)： | 211/250頁(yè) |
| 文件大小： | 0K |
| 描述： | IC FPGA 1KB FLASH 250K 144FBGA |
| 標(biāo)準(zhǔn)包裝： | 160 |
| 系列： | IGLOO |
| 邏輯元件/單元數(shù)： | 6144 |
| RAM 位總計(jì)： | 36864 |
| 輸入/輸出數(shù)： | 97 |
| 門數(shù)： | 250000 |
| 電源電壓： | 1.14 V ~ 1.575 V |
| 安裝類型： | 表面貼裝 |
| 工作溫度： | -40°C ~ 85°C |
| 封裝/外殼： | 144-LBGA |
| 供應(yīng)商設(shè)備封裝： | 144-FPBGA（13x13） |
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IGLOO Low Power Flash FPGAs
Revision 23
2-47
3.3 V LVCMOS Wide Range
Table 2-63 Minimum and Maximum DC Input and Output Levels for LVCMOS 3.3 V Wide Range
Applicable to Advanced I/O Banks
3.3 V LVCMOS Wide Range
VIL
VIH
VOL
VOH
IOL IOH
IOSL
IOSH
IIL2 IIH3
Drive
Strength
Equivalent
Software
Default Drive
Strength
Option1
Min.
V
Max.
V
Min.
V
Max.
V
Max.
V
Min.
VA
A
Max.
mA4
Max.
mA4
A5 A5
100 A
2 mA
–0.3
0.8
2
3.6
0.2
VDD – 0.2
100 100
25
27
10 10
100 A
4 mA
–0.3
0.8
2
3.6
0.2
VDD – 0.2
100 100
25
27
10 10
100 A
6 mA
–0.3
0.8
2
3.6
0.2
VDD – 0.2
100 100
51
54
10 10
100 A
8 mA
–0.3
0.8
2
3.6
0.2
VDD – 0.2
100 100
51
54
10 10
100 A
12 mA
–0.3
0.8
2
3.6
0.2
VDD – 0.2
100 100
103
109
10 10
100 A
16 mA
–0.3
0.8
2
3.6
0.2
VDD – 0.2
100 100
132
127
10 10
100 A
24 mA
–0.3
0.8
2
3.6
0.2
VDD – 0.2
100 100
268
181
10 10
Notes:
1. The minimum drive strength for any LVCMOS 3.3 V software configuration when run in wide range is ± 100 A. Drive
strengths displayed in software are supported for normal range only. For a detailed I/V curve, refer to the IBIS models.
2. IIL is the input leakage current per I/O pin over recommended operation conditions where –0.3 V < VIN < VIL.
3. IIH is the input leakage current per I/O pin over recommended operating conditions VIH < VIN < VCCI. Input current is
larger when operating outside recommended ranges
4. Currents are measured at 100°C junction temperature and maximum voltage.
5. Currents are measured at 85°C junction temperature.
6. Software default selection highlighted in gray.
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PDF描述 |
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