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參數(shù)資料
| 型號(hào)： | AGL250V2-FG144I |
| 廠商： | Microsemi SoC |
| 文件頁(yè)數(shù)： | 6/250頁(yè) |
| 文件大小： | 0K |
| 描述： | IC FPGA 1KB FLASH 250K 144FBGA |
| 標(biāo)準(zhǔn)包裝： | 160 |
| 系列： | IGLOO |
| 邏輯元件/單元數(shù)： | 6144 |
| RAM 位總計(jì)： | 36864 |
| 輸入/輸出數(shù)： | 97 |
| 門數(shù)： | 250000 |
| 電源電壓： | 1.14 V ~ 1.575 V |
| 安裝類型： | 表面貼裝 |
| 工作溫度： | -40°C ~ 85°C |
| 封裝/外殼： | 144-LBGA |
| 供應(yīng)商設(shè)備封裝： | 144-FPBGA（13x13） |
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IGLOO Low Power Flash FPGAs
Revision 23
2-87
Input Register
Timing Characteristics
1.5 V DC Core Voltage
Figure 2-18 Input Register Timing Diagram
50%
Preset
Clear
Out_1
CLK
Data
Enable
t
ISUE
50%
t
ISUD
t
IHD
50%
t
ICLKQ
1
0
t
IHE
t
IRECPRE
t
IREMPRE
t
IRECCLR
t
IREMCLR
t
IWCLR
t
IWPRE
t
IPRE2Q
t
ICLR2Q
t
ICKMPWH tICKMPWL
50%
Table 2-157 Input Data Register Propagation Delays
Commercial-Case Conditions: TJ = 70°C, Worst-Case VCC = 1.425 V
Parameter
Description
Std.
Units
tICLKQ
Clock-to-Q of the Input Data Register
0.42
ns
tISUD
Data Setup Time for the Input Data Register
0.47
ns
tIHD
Data Hold Time for the Input Data Register
0.00
ns
tISUE
Enable Setup Time for the Input Data Register
0.67
ns
tIHE
Enable Hold Time for the Input Data Register
0.00
ns
tICLR2Q
Asynchronous Clear-to-Q of the Input Data Register
0.79
ns
tIPRE2Q
Asynchronous Preset-to-Q of the Input Data Register
0.79
ns
tIREMCLR
Asynchronous Clear Removal Time for the Input Data Register
0.00
ns
tIRECCLR
Asynchronous Clear Recovery Time for the Input Data Register
0.24
ns
tIREMPRE
Asynchronous Preset Removal Time for the Input Data Register
0.00
ns
tIRECPRE
Asynchronous Preset Recovery Time for the Input Data Register
0.24
ns
tIWCLR
Asynchronous Clear Minimum Pulse Width for the Input Data Register
0.19
ns
tIWPRE
Asynchronous Preset Minimum Pulse Width for the Input Data Register
0.19
ns
tICKMPWH
Clock Minimum Pulse Width High for the Input Data Register
0.31
ns
tICKMPWL
Clock Minimum Pulse Width Low for the Input Data Register
0.28
ns
Note: For specific junction temperature and voltage supply levels, refer to Table 2-6 on page 2-7 for derating values.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| VI-J3P-CW | CONVERTER MOD DC/DC 13.8V 100W |
| ADM1026JSTZ-R7 | IC CTRLR SYS REF/EEPROM 48LQFP |
| EBC08DRXN-S734 | CONN EDGECARD 16POS DIP .100 SLD |
| F950J107MSAAM1Q2 | CAP TANT 100UF 6.3V 20% 1206 |
| AIML-0603-R82K-T | INDUCTOR MULTILAYER 820NH 0603 |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| AGL250V2-FG144T | 制造商:Microsemi Corporation 功能描述:AGL250V2-FG144T - Trays 制造商:Microsemi Corporation 功能描述:IC FPGA 250K GATES 144FBGA |
| AGL250V2-FGG144 | 功能描述:IC FPGA IGLOO 1.2-1.5V 144FPBGA RoHS:是 類別:集成電路 (IC) >> 嵌入式 - FPGA（現(xiàn)場(chǎng)可編程門陣列） 系列:IGLOO 標(biāo)準(zhǔn)包裝:60 系列:XP LAB/CLB數(shù):- 邏輯元件/單元數(shù):10000 RAM 位總計(jì):221184 輸入/輸出數(shù):244 門數(shù):- 電源電壓:1.71 V ~ 3.465 V 安裝類型:表面貼裝 工作溫度:0°C ~ 85°C 封裝/外殼:388-BBGA 供應(yīng)商設(shè)備封裝:388-FPBGA（23x23） 其它名稱:220-1241 |
| AGL250V2-FGG144I | 功能描述:IC FPGA 1KB FLASH 250K 144FBGA RoHS:是 類別:集成電路 (IC) >> 嵌入式 - FPGA（現(xiàn)場(chǎng)可編程門陣列） 系列:IGLOO 標(biāo)準(zhǔn)包裝:152 系列:IGLOO PLUS LAB/CLB數(shù):- 邏輯元件/單元數(shù):792 RAM 位總計(jì):- 輸入/輸出數(shù):120 門數(shù):30000 電源電壓:1.14 V ~ 1.575 V 安裝類型:表面貼裝 工作溫度:-40°C ~ 85°C 封裝/外殼:289-TFBGA，CSBGA 供應(yīng)商設(shè)備封裝:289-CSP（14x14） |
| AGL250V2-FGG144T | 制造商:Microsemi Corporation 功能描述:AGL250V2-FGG144T - Trays 制造商:Microsemi Corporation 功能描述:IC FPGA 97 I/O 144FBGA |
| AGL250V2-FQN144 | 制造商:ACTEL 制造商全稱:Actel Corporation 功能描述:IGLOO Low-Power Flash FPGAs with Flash Freeze Technology |
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