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參數資料
| 型號： | MC68030RC25 |
| 廠商： | MOTOROLA INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | ENHANCED 32-BIT MICROPROCESSOR |
| 中文描述： | 32-BIT, 25 MHz, MICROPROCESSOR, CPGA128 |
| 封裝： | PGA-128 |
| 文件頁數： | 20/602頁 |
| 文件大小： | 3863K |
| 代理商： | MC68030RC25 |
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MOTOROLA
MC68030 USER’S MANUAL
xli
Figure
Number
9-38
9-39
9-40
Title
Page
Number
LIST OF ILLUSTRATIONS (Continued)
MMU Status Register (MMUSR) Format . . . . . . . . . . . . . . . . . . . . . . . . . . 9-59
MMU Status Interpretation PTEST Level 0 . . . . . . . . . . . . . . . . . . . . . . . . 9-62
MMU Status Interpretation PTEST Level 7 . . . . . . . . . . . . . . . . . . . . . . . . 9-63
10-1
10-2
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10-10
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10-12
F-Line Coprocessor Instruction Operation Word . . . . . . . . . . . . . . . . . . . . 10-4
Asynchronous Non-DMA M68000 Coprocessor Interface Signal Usage. . 10-6
MC68030 CPU Space Address Encodings . . . . . . . . . . . . . . . . . . . . . . . . 10-7
Coprocessor Address Map in MC68030 CPU Space. . . . . . . . . . . . . . . . . 10-8
Coprocessor Interface Register Set Map. . . . . . . . . . . . . . . . . . . . . . . . . . 10-9
Coprocessor General Instruction Format (cpGEN) . . . . . . . . . . . . . . . . . . 10-10
Coprocessor Interface Protocol for General Category Instructions . . . . . . 10-11
Coprocessor Interface Protocol for Conditional Category Instructions. . . . 10-13
Branch on Coprocessor Condition Instruction (cpBcc.W) . . . . . . . . . . . . . 10-14
Branch On Coprocessor Condition Instruction (cpBcc.L). . . . . . . . . . . . . . 10-14
Set On Coprocessor Condition (cpScc) . . . . . . . . . . . . . . . . . . . . . . . . . . . 10-15
Test Coprocessor Condition, Decrement and Branch
Instruction Format (cpDBcc). . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 10-17
Trap On Coprocessor Condition (cpTRAPcc) . . . . . . . . . . . . . . . . . . . . . . 10-18
Coprocessor State Frame Format in Memory . . . . . . . . . . . . . . . . . . . . . . 10-21
Coprocessor Context Save Instruction Format (cpSAVE) . . . . . . . . . . . . . 10-25
Coprocessor Context Save Instruction Protocol. . . . . . . . . . . . . . . . . . . . . 10-26
Coprocessor Context Restore Instruction Format (cpRESTORE) . . . . . . . 10-27
Coprocessor Context Restore Instruction Protocol . . . . . . . . . . . . . . . . . . 10-28
Control CIR Format . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 10-30
Condition CIR Format. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 10-31
Operand Alignment for Operand CIR Accesses. . . . . . . . . . . . . . . . . . . . . 10-32
Coprocessor Response Primitive Format. . . . . . . . . . . . . . . . . . . . . . . . . . 10-35
Busy Primitive Format . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 10-36
Null Primitive Format . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 10-37
Supervisor Check Primitive Format . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 10-40
Transfer Operation Word Primitive Format . . . . . . . . . . . . . . . . . . . . . . . . 10-41
Transfer from Instruction Stream Primitive Format . . . . . . . . . . . . . . . . . . 10-41
Evaluate and Transfer Effective Address Primitive Format . . . . . . . . . . . . 10-42
Evaluate Effective Address and Transfer Data Primitive . . . . . . . . . . . . . . 10-43
Write to Previously Evaluated EffectiveAddress Primitive Format . . . . . . . 10-46
Take Address and Transfer Data Primitive Format . . . . . . . . . . . . . . . . . . 10-48
Transfer To/From Top of Stack Primitive Format. . . . . . . . . . . . . . . . . . . . 10-49
Transfer Single Main Processor Register Primitive Format . . . . . . . . . . . . 10-50
Transfer Main Processor Control Register Primitive Format . . . . . . . . . . . 10-51
Transfer Multiple Main Processor Registers Primitive Format . . . . . . . . . . 10-52
Register Select Mask Format. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 10-52
Transfer Multiple Coprocessor Registers Primitive Format . . . . . . . . . . . . 10-53
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相關PDF資料 |
PDF描述 |
|---|---|
| MC68030RC33 | ENHANCED 32-BIT MICROPROCESSOR |
| MC68030FE20 | ENHANCED 32-BIT MICROPROCESSOR |
| MC68030 | QUad Integrated Communications Controller Users Manual |
| MC68030FE33 | ENHANCED 32-BIT MICROPROCESSOR |
| MC68040V | 32-Bit Microprocessor(32位微處理器) |
相關代理商/技術參數 |
參數描述 |
|---|---|
| MC68030RC25B | 制造商:Motorola Inc 功能描述: |
| MC68030RC25C | 功能描述:微處理器 - MPU 32B ON-CHIP CACHE MMU RoHS:否 制造商:Atmel 處理器系列:SAMA5D31 核心:ARM Cortex A5 數據總線寬度:32 bit 最大時鐘頻率:536 MHz 程序存儲器大小:32 KB 數據 RAM 大小:128 KB 接口類型:CAN, Ethernet, LIN, SPI,TWI, UART, USB 工作電源電壓:1.8 V to 3.3 V 最大工作溫度:+ 85 C 安裝風格:SMD/SMT 封裝 / 箱體:FBGA-324 |
| MC68030RC25C | 制造商:FREESCALE SEMICONDUCTOR 功能描述:_ |
| MC68030RC33 | 制造商:MOTOROLA 制造商全稱:Motorola, Inc 功能描述:ENHANCED 32-BIT MICROPROCESSOR |
| MC68030RC33B | 制造商:Motorola Inc 功能描述:68030RC33B |
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