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參數(shù)資料
| 型號： | MC68030RC25 |
| 廠商： | MOTOROLA INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | ENHANCED 32-BIT MICROPROCESSOR |
| 中文描述： | 32-BIT, 25 MHz, MICROPROCESSOR, CPGA128 |
| 封裝： | PGA-128 |
| 文件頁數(shù)： | 465/602頁 |
| 文件大小： | 3863K |
| 代理商： | MC68030RC25 |
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Instruction Execution Timing
11-30
MC68030 USER’S MANUAL
MOTOROLA
11.6.2 Fetch Immediate Effective Address (fiea) (Continued)
B = Base Address: 0, An, PC, Xn, An+Xn, PC+Xn. Form does not affect timing.
I = Index: 0, Xn
% = Total head for fetch immediate effective address timing includes the head time for the operation.
NOTE: Xn cannot be in B and I at the same time. Scaling and size of Xn do not affect timing.
11.6.3 Calculate Effective Address (cea)
The calculate effective address table indicates the number of clock periods needed for the
processor to calculate the specified effective address. Fetch time is only included for the first
level of indirection on memory indirect addressing modes. The effective addresses are
divided by their formats (refer to
2.5 Effective Address Encoding Summary
). For
instruction-cache case and for no-cache case, the total number of clock cycles is outside the
parentheses. The number of read, prefetch, and write cycles is given inside the parentheses
as (r/p/w). The read, prefetch, and write cycles are included in the total clock cycle number.
All timing data assumes two-clock reads and writes.
Address Mode
Head
Tail
I-Cache Case No-Cache Case
#
data
.W, ([d
16
, B],d
16
)
#
data
.L, ([d
16
, B}, d
16
)
#
data
.W,([d
16
,B],I,d
16
)
#
data
.L, ([d
16
,B],I,d
16
)
#
data
.W,([d
16
,B],d
32
)
#
data
.L, ([d
16
,B],d
32
)
#
data
.W,([d
16
,B],I,d
32
)
#
data
.L,([d
16
,B],I,d
16
)
#
data
.W,([d
16
,B])
#
data
.L,([d
16
,B])
#
data
.W,([d
32
,B],I)
#
data
.L,([d
32
,B],I)
#
data
.W,([d
32
,B],d
16)
#
data
.L,([d
32
,B],d
16
)
#
data
.W,([d
32
,B],I,d
16
)
#
data
.L,([d
32
,B],I,d
16
)
#
data
.W,([d
32
,B],d
32
)
#
data
.L,([d
32
,B],d
32
)
#
data
.W,([d
32
,B],I,d
32
)
#
data
.L,([d
32
,B],I,d
32
)
6
8
6
8
6
8
6
8
6
8
6
8
6
8
6
8
6
8
6
8
0
0
0
0
0
0
0
0
0
0
0
0
0
0
0
0
0
0
0
0
16
(2/0/0)
18
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16
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18
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16
(2/0/0)
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16
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18
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相關(guān)PDF資料 |
PDF描述 |
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| MC68030RC33 | ENHANCED 32-BIT MICROPROCESSOR |
| MC68030FE20 | ENHANCED 32-BIT MICROPROCESSOR |
| MC68030 | QUad Integrated Communications Controller Users Manual |
| MC68030FE33 | ENHANCED 32-BIT MICROPROCESSOR |
| MC68040V | 32-Bit Microprocessor(32位微處理器) |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| MC68030RC25B | 制造商:Motorola Inc 功能描述: |
| MC68030RC25C | 功能描述:微處理器 - MPU 32B ON-CHIP CACHE MMU RoHS:否 制造商:Atmel 處理器系列:SAMA5D31 核心:ARM Cortex A5 數(shù)據(jù)總線寬度:32 bit 最大時鐘頻率:536 MHz 程序存儲器大小:32 KB 數(shù)據(jù) RAM 大小:128 KB 接口類型:CAN, Ethernet, LIN, SPI,TWI, UART, USB 工作電源電壓:1.8 V to 3.3 V 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:FBGA-324 |
| MC68030RC25C | 制造商:FREESCALE SEMICONDUCTOR 功能描述:_ |
| MC68030RC33 | 制造商:MOTOROLA 制造商全稱:Motorola, Inc 功能描述:ENHANCED 32-BIT MICROPROCESSOR |
| MC68030RC33B | 制造商:Motorola Inc 功能描述:68030RC33B |
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