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參數(shù)資料
| 型號： | MC68EN360FE25 |
| 廠商： | MOTOROLA INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | AC 4C 4#12 PIN PLUG 023 |
| 中文描述： | 32-BIT, 25 MHz, RISC MICROCONTROLLER, CQFP240 |
| 封裝： | CERAMIC, QFP-240 |
| 文件頁數(shù)： | 308/962頁 |
| 文件大小： | 2817K |
| 代理商： | MC68EN360FE25 |
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System Integration Module (SIM60)
6-64
MC68360 USER’S MANUAL
MOTOROLA
6.13 PROGRAMMING MODEL
The user interfaces with the memory controller using eight identical sets of two registers, the
BR and OR. There are also two global registers in the memory controller: the GMR and the
MSTAT.
6.13.1 Global Memory Register (GMR)
The 32-bit read-write GMR contains selections that are common to the entire memory con-
troller: DRAM refresh properties, DRAM bank properties, SRAM bank properties, and some
global SRAM/DRAM properties. The reserved bits (4–0) should be written with zero.
SUPERVISOR SPACE ONLY
The following bits are used for DRAM refresh properties.
RCNT7–RCNT0—Refresh Counter Period
These bits determine the refresh period according to the following equation:
Example: For a 25-MHz system clock and a required refresh rate of 15.6
μ
s per row, the
RFCNT value should be 24 (decimal). 24/(25 MHz/16) = 15.36
μ
s, which is less than the
required refresh period of 15.6
μ
s.
RFEN—Refresh Enable
0 = DRAM refresh is disabled.
1 = DRAM refresh is enabled.
RCYC1–RCYC0—Refresh Cycle Length
These bits determine the length of a refresh cycle.
00 = The refresh cycle is 4 clocks long, and RAS is negated for 3 phases prior to being
asserted.
01 = The refresh cycle is 6 clocks long, and RAS is negated for 5 phases prior to being
asserted.
10 = The refresh cycle is 7 clocks long, and RAS is negated for 5 phases prior to being
asserted.
11 = The refresh cycle is 8 clocks long, and RAS is negated for 5 phases prior to being
asserted.
31
30
29
28
27
26
25
24
23
22
21
20
19
18
17
16
RCNT7
0
RCNT6
0
RCNT5
0
RCNT4
0
RCNT3
0
RCNT2
0
RCNT1
0
RCNT0
0
RFEN
0
RCYC1 RCYC0
0
PGS2
0
PGS1
0
PGS0
0
DPS1
0
DPS0
0
0
15
14
13
12
11
10
9
8
7
6
5
4
—
0
3
—
0
2
—
0
1
—
0
0
—
0
WBT40
0
WBTQ
0
SYNC
0
EMWS
1
OPAR
0
PBEE
0
TSS40
1
NCS
0
DWQ
0
DW40
0
GAMX
0
Refresh period
=
RFCNT+1
System clk/16
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PDF描述 |
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