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參數(shù)資料
| 型號： | MC68EN360FE25 |
| 廠商： | MOTOROLA INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | AC 4C 4#12 PIN PLUG 023 |
| 中文描述： | 32-BIT, 25 MHz, RISC MICROCONTROLLER, CQFP240 |
| 封裝： | CERAMIC, QFP-240 |
| 文件頁數(shù)： | 435/962頁 |
| 文件大?。?/td> | 2817K |
| 代理商： | MC68EN360FE25 |
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Serial Communication Controllers (SCCs)
MOTOROLA
MC68360 USER’S MANUAL
7-111
Each SCC may be connected to its own set of pins on the QUICC. This configuration is
called the NMSI and is described in 7.8 Serial Interface with Time Slot Assigner. In this con-
figuration, each SCC can support the standard modem interface signals (RTS, CTS, and
CD) through the port C pins and the CPM interrupt controller (CPIC). Additional handshake
signals may be supported with additional parallel I/O lines.
Refer to the SCC block diagram in Figure 7-37.
Figure 7-37. SCC Block Diagram
7.10.2 General SCC Mode Register (GSMR)
Each SCC contains a GSMR that defines all the options that are common to each SCC,
regardless of the protocol. Detailed descriptions of some of the operations of the GSMR are
given in later sections. GSMR is a read-write register that is cleared at reset. Since GSMR
is 64 bits in length, it is accessed as GSMR_L and GSMR_H. GSMR_L contains the first
(low-order) 32 bits of GSMR; GSMR_H contains the last 32 bits of GSMR.
63
62
61
60
59
58
57
56
—
40
CDS
24
TINV
55
54
53
52
51
50
49
48
GDE
32
RSYN
16
47
46
45
44
TRX
28
TCI
43
TTX
27
42
CDP
26
41
39
38
TFL
22
TPL
37
RFW
21
36
35
34
33
TCRC
REVD
29
CTSP
25
RINV
CTSS
23
TXSY
20
SYNL
RTSM
17
31
—
30
19
18
Tend
EDGE
TSNC
TPP
TDCR
15
14
13
12
11
10
9
8
7
6
5
4
3
2
1
0
RDCR
RENC
TENC
DIAG
ENR
ENT
MODE
IMB
CONTROL
REGISTERS
DPLL
AND CLOCK
RECOVERY
TCLKx
RCLKx
CLOCK
GENERATOR
PERIPHERAL BUS
MODEMLINES
RECEIVER
CONTROL
UNIT
RECEIVE
DATA
FIFO
TRANSMITTER
CONTROL
UNIT
TRANSMIT
DATA
FIFO
DECODER
DELIMITER
SHIFTER
DELIMITER
SHIFTER
ENCODER
TXD
MODEMLINES
INTERNAL CLOCKS
RXD
相關PDF資料 |
PDF描述 |
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