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參數資料
| 型號： | MC68EN360FE25 |
| 廠商： | MOTOROLA INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | AC 4C 4#12 PIN PLUG 023 |
| 中文描述： | 32-BIT, 25 MHz, RISC MICROCONTROLLER, CQFP240 |
| 封裝： | CERAMIC, QFP-240 |
| 文件頁數： | 729/962頁 |
| 文件大?。?/td> | 2817K |
| 代理商： | MC68EN360FE25 |
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Applications
MOTOROLA
MC68360 USER’S MANUAL
9-9
Figure 9-6. Glueless Interface to MCM36100S SRAM
9.1.2.7 DRAM DEVICES.
devices. In this case, the MCM54260 256K
32-bit-wide DRAM solution using only two DRAM devices, with byte writes still supported
using the upper and lower CAS pins. The RAS1 line should be programmed to respond to
a 1-Mbyte address space.
Figure 9-7 shows the glueless interface to standalone DRAM
×
16 DRAM device is chosen. This allows a full
The address multiplexing scheme shown is the same as that for the DRAM SIMM. No parity
support is provided in this case. The RAS1DD signal is not used in this case since only two
devices are supported.
After power-on reset, the software must wait the required time before accessing the DRAM.
The required eight read cycles must be performed either in software or by waiting for the
refresh controller to perform these accesses.
MA0
MA1
MA2
MA3
MA4
MA5
MA6
MA7
MA8
MA9
RAS1
RAS1DD
CAS0
CAS1
CAS2
CAS3
R/W
D7DD0
PRTY3
D15DD8
PRTY2
D23DD16
PRTY1
D31DD24
PRTY0
A0
A1
A2
A3
A4
A5
A6
A7
A8
A9
RAS0
RAS2
W
SYSTEMBUS
AND
QUICC-GENERATED
SIGNALS
MCM36100S
1M 36 BIT DRAM
MODULE
A11DA2
CAS0
CAS1
CAS2
CAS3
DQ7DDQ0
DQ8
DQ16DDQ9
DQ17
DQ25DDQ18
DQ26
DQ34DDQ27
DQ35
1M 4
1M 1
1M 1
1M 4
1M 4
1M 4
1M 4
1M 4
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1M 4
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相關PDF資料 |
PDF描述 |
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