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參數資料
型號: MC68302PV16V
廠商: MOTOROLA INC
元件分類: 微控制器/微處理器
英文描述: Integrated Multiprotocol Processor User’s Manual
中文描述: RISC PROCESSOR, PQFP144
封裝: TQFP-144
文件頁數: 149/480頁
文件大小: 1815K
代理商: MC68302PV16V
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Communications Processor (CP)
MOTOROLA
MC68302 USER’S MANUAL
4-29
allel I/O lines in the PACNT register. To cause the TXD and RTS pins to simply
remain high in NMSI1, NMSI2, and NMSI3 modes, use this loopback mode in con-
junction with setting the SDIAG1–SDIAG0 bits in the SIMODE register to loop-
back control.
Figure 4-13. Output Delays from RTS Low, Synchronous Protocol
Figure 4-14. Output Delays from CTS Low, Synchronous Protocol
If an internal loopback is desired when this SCC is configured to a multiplexed
physical interface, then only the SDIAG1–SDIAG0 bits need be set.
When using loopback mode, the clock source for the transmitter and the receiver
(as set in the TCS and RCS bits in the SCON register), must be the same. Thus,
TXD
RTS
CTS
FIRST BIT OF DATA IN FRAME
LAST BIT OF FRAME DATA
(INPUT)
TCLK
(I/O)
(OUTPUT)
(OUTPUT)
NOTE: A "frame" includes opening and closing flags in HDLC and SYNCs in BISYNC and DDCMP.
TXD
RTS
CTS
FIRST BIT OF FRAME
LAST BIT OF FRAME
(INPUT)
(OUTPUT)
(OUTPUT)
CTS SAMPLED AS LOW HERE
3.5 TCLKS
CTS MUST NOT BE NEGATED
UNTIL RTS IS NEGATED,
OR A CTS LOST ERROR
WILL RESULT.
TCLK
(I/O)
NOTE: A "frame" includes opening and closing flags, SYNCs, etc.
DATA READY TO TRANSMIT HERE
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