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參數資料
| 型號： | MC68302PV16V |
| 廠商： | MOTOROLA INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | Integrated Multiprotocol Processor User’s Manual |
| 中文描述： | RISC PROCESSOR, PQFP144 |
| 封裝： | TQFP-144 |
| 文件頁數： | 277/480頁 |
| 文件大小： | 1815K |
| 代理商： | MC68302PV16V |
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Signal Description
MOTOROLA
MC68302 USER’S MANUAL
5-13
**
If DTACK is generated automatically (internally) by the chip-select logic, then it is an output. Otherwise, it is an
input.
***
BERR is an open-drain output, and may be asserted by the IMP when the hardware watchdog is used or when
the chip-select logic detects address conflict or write protect violation. BERR may be asserted by external logic in
all cases.
# Applies to disable CPU mode only. The internal signal IBCLR is used otherwise.
## Applies to disable CPU mode only, otherwise N/A.
5.11 PHYSICAL LAYER SERIAL INTERFACE PINS
The physical layer serial interface has 24 pins, and all but one of them have multiple func-
tionality. The pins can be used in a variety of configurations in ISDN or non-ISDN environ-
ments. Table 5-3 shows the functionality of each group of pins and their internal connection
to the three SCC and one SCP controllers. The physical layer serial interface can be config-
ured for non-multiplexed operation (NMSI) or multiplexed operation that includes IDL, GCI,
and PCM highway modes. IDL and GCI are ISDN interfaces. When working in one of the
multiplexed modes, the NMSI1/ISDN physical interface can be connected to all three SCC
controllers.
NOTE: Each one of the parallel I/O pins can be configured individually.
Table 5-3. Bus Signal Summary—IDMA and SDMA
IDMA Master
Access To
SDMA Master
Access To
Signal Name
Pin Type
Internal
Memory
Space
External
Memory
Space
Internal
Memory
Space
External
Memory
Space
A23–A1, FC–FC0,
AS, UDS, LDS, R/W, RMC
BCLR
IAC
D15—D0 Read
D15—D0 Write
I/O
O
O
N/A
O
I/O Open Drain
O
I/O
I/O
I #
O
O
O
I #
O
I
O
**
N/A
N/A
N/A
N/A
O
O
I
O
**
DTACK
I/O
O
N/A
BR
BG
BGACK
HALT
RESET
I/O
I/O
I/O
O ##
I ##
O
I
I
***
O ##
I ##
O
I
I
***
N/A
N/A
N/A
N/A
N/A
O ##
I ##
O
I
I
***
I/O Open Drain
I/O Open Drain
BERR
I/O Open Drain
I/O
I/O
N/A
I/O
Table 5-4. Serial Interface Pin Functions
First Function
Connected To
Second Function
Connected To
NMSI1 (8)
NMSI2 (8)
NMSI3 (5)
NMSI3 (3)
SCC1 Controller
SCC2 Controller
SCC3 Controller
SCC3 Controller
ISDN Interface
PIO—Port A
PIO—Port A
SCP
SCC1/SCC2/SCC3
Parallel I/O
Parallel I/O
SCP Controller
相關PDF資料 |
PDF描述 |
|---|---|
| MC68302PV20 | Integrated Multiprotocol Processor User’s Manual |
| MC68302RC20 | Integrated Multiprotocol Processor User’s Manual |
| MC68302RC25 | Integrated Multiprotocol Processor User’s Manual |
| MC68302AD | Integrated Multiprotocol Processor with PCMCIA |
| MC68302UM | Integrated Multiprotocol Processor with PCMCIA |
相關代理商/技術參數 |
參數描述 |
|---|---|
| MC68302PV16VC | 功能描述:IC MPU MULTI-PROTOCOL 144-LQFP RoHS:否 類別:集成電路 (IC) >> 嵌入式 - 微處理器 系列:M683xx 標準包裝:2 系列:MPC8xx 處理器類型:32-位 MPC8xx PowerQUICC 特點:- 速度:133MHz 電壓:3.3V 安裝類型:表面貼裝 封裝/外殼:357-BBGA 供應商設備封裝:357-PBGA（25x25） 包裝:托盤 |
| MC68302PV20 | 制造商:MOTOROLA 制造商全稱:Motorola, Inc 功能描述:Integrated Multiprotocol Processor User’s Manual |
| MC68302PV20C | 功能描述:IC MPU MULTI-PROTOCOL 144-LQFP RoHS:否 類別:集成電路 (IC) >> 嵌入式 - 微處理器 系列:M683xx 標準包裝:2 系列:MPC8xx 處理器類型:32-位 MPC8xx PowerQUICC 特點:- 速度:133MHz 電壓:3.3V 安裝類型:表面貼裝 封裝/外殼:357-BBGA 供應商設備封裝:357-PBGA（25x25） 包裝:托盤 |
| MC68302PV25C | 功能描述:IC MPU MULTI-PROTOCOL 144-LQFP RoHS:否 類別:集成電路 (IC) >> 嵌入式 - 微處理器 系列:M683xx 標準包裝:2 系列:MPC8xx 處理器類型:32-位 MPC8xx PowerQUICC 特點:- 速度:133MHz 電壓:3.3V 安裝類型:表面貼裝 封裝/外殼:357-BBGA 供應商設備封裝:357-PBGA（25x25） 包裝:托盤 |
| MC68302PV33C | 功能描述:IC MPU NETWORK 33MHZ 144-LQFP RoHS:否 類別:集成電路 (IC) >> 嵌入式 - 微處理器 系列:M683xx 標準包裝:2 系列:MPC8xx 處理器類型:32-位 MPC8xx PowerQUICC 特點:- 速度:133MHz 電壓:3.3V 安裝類型:表面貼裝 封裝/外殼:357-BBGA 供應商設備封裝:357-PBGA（25x25） 包裝:托盤 |
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