- 您現(xiàn)在的位置：買(mǎi)賣(mài)IC網(wǎng) > PDF目錄371046 > MC68EN360ZP25 (MOTOROLA INC) QUad Integrated Communications Controller Users Manual PDF資料下載
參數(shù)資料
| 型號(hào)： | MC68EN360ZP25 |
| 廠商： | MOTOROLA INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | QUad Integrated Communications Controller Users Manual |
| 中文描述： | 32-BIT, 25 MHz, RISC MICROCONTROLLER, PBGA357 |
| 封裝： | BGA-357 |
| 文件頁(yè)數(shù)： | 19/962頁(yè) |
| 文件大小： | 2817K |
| 代理商： | MC68EN360ZP25 |
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Table of Contents
Paragraph
Number
Title
Page
Number
MOTOROLA
MC68360 USER’S MANUAL
xv
7.10.20.9
7.10.20.10
7.10.20.10.1 Transmission Errors............................................................................ 7-209
7.10.20.10.2 Reception Errors ................................................................................. 7-209
7.10.20.11
BISYNC Mode Register (PSMR)......................................................... 7-209
7.10.20.12
BISYNC Receive Buffer Descriptor (Rx BD)....................................... 7-211
7.10.20.13
BISYNC Transmit Buffer Descriptor (Tx BD)....................................... 7-213
7.10.20.14
BISYNC Event Register (SCCE)......................................................... 7-216
7.10.20.15
BISYNC Mask Register (SCCM)......................................................... 7-217
7.10.20.16
SCC Status Register (SCCS).............................................................. 7-217
7.10.20.17
Programming the BISYNC Controller.................................................. 7-217
7.10.20.18
SCC BISYNC Example ....................................................................... 7-218
7.10.21
Transparent Controller ........................................................................ 7-220
7.10.21.1
Transparent Controller Features......................................................... 7-221
7.10.21.2
Transparent Channel Frame Transmission Processing...................... 7-221
7.10.21.3
Transparent Channel Frame Reception Processing........................... 7-222
7.10.21.4
Achieving Synchronization in Transparent Mode................................ 7-223
7.10.21.4.1
In-Line Synchronization Pattern.......................................................... 7-223
7.10.21.4.2
Transparent Synchronization Example ............................................... 7-224
7.10.21.5
Transparent Memory Map................................................................... 7-225
7.10.21.6
Transparent Command Set................................................................. 7-226
7.10.21.6.1
Transmit Commands........................................................................... 7-226
7.10.21.6.2
Receive Commands............................................................................ 7-227
7.10.21.7
Transparent Error-Handling Procedure............................................... 7-227
7.10.21.7.1
Transmission Errors............................................................................ 7-227
7.10.21.7.2
Reception Errors ................................................................................. 7-228
7.10.21.8
Transparent Mode Register (PSMR)................................................... 7-228
7.10.21.9
Transparent Receive Buffer Descriptor (Rx BD)................................. 7-228
7.10.21.10
Transparent Transmit Buffer Descriptor (Tx BD)................................. 7-230
7.10.21.11
Transparent Event Register (SCCE)................................................... 7-232
7.10.21.12
Transparent Mask Register (SCCM)................................................... 7-233
7.10.21.13
SCC Status Register (SCCS).............................................................. 7-233
7.10.21.14
SCC Transparent Example ................................................................. 7-233
7.10.22
RAM Microcodes................................................................................. 7-235
7.10.23
Ethernet Controller.............................................................................. 7-235
7.10.23.1
Ethernet On QUICC—MC68EN360.................................................... 7-236
7.10.23.2
Ethernet Key Features ........................................................................ 7-237
7.10.23.3
Learning Ethernet on the QUICC........................................................ 7-238
7.10.23.4
Connecting QUICC to Ethernet........................................................... 7-239
7.10.23.5
Ethernet Channel Frame Transmission............................................... 7-241
7.10.23.6
Ethernet Channel Frame Reception.................................................... 7-242
7.10.23.7
CAM Interface ..................................................................................... 7-243
7.10.23.8
Ethernet Memory Map......................................................................... 7-246
7.10.23.9
Ethernet Programming Model ............................................................. 7-250
7.10.23.10
Ethernet Command Set....................................................................... 7-250
Transmitting and Receiving the Synchronization Sequence............... 7-208
BISYNC Error-Handling PROCEDURE............................................... 7-209
相關(guān)PDF資料 |
PDF描述 |
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| MC68MH360FE25V | QUad Integrated Communications Controller Users Manual |
| MC68MH360FE33 | QUad Integrated Communications Controller Users Manual |
| MC68MH360RC25 | QUad Integrated Communications Controller Users Manual |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
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| MC68EN360ZP25LR2 | 功能描述:IC MPU QUICC 32BIT 25MHZ 357PBGA RoHS:否 類別:集成電路 (IC) >> 嵌入式 - 微處理器 系列:M683xx 標(biāo)準(zhǔn)包裝:1 系列:MPC85xx 處理器類型:32-位 MPC85xx PowerQUICC III 特點(diǎn):- 速度:1.2GHz 電壓:1.1V 安裝類型:表面貼裝 封裝/外殼:783-BBGA，F(xiàn)CBGA 供應(yīng)商設(shè)備封裝:783-FCPBGA（29x29） 包裝:托盤(pán) |
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| MC68EN360ZP33L | 功能描述:IC MPU QUICC 32BIT 33MHZ 357PBGA RoHS:否 類別:集成電路 (IC) >> 嵌入式 - 微處理器 系列:M683xx 標(biāo)準(zhǔn)包裝:1 系列:MPC85xx 處理器類型:32-位 MPC85xx PowerQUICC III 特點(diǎn):- 速度:1.2GHz 電壓:1.1V 安裝類型:表面貼裝 封裝/外殼:783-BBGA，F(xiàn)CBGA 供應(yīng)商設(shè)備封裝:783-FCPBGA（29x29） 包裝:托盤(pán) |
| MC68EN360ZQ25L | 功能描述:微處理器 - MPU QUICC ETHRN RoHS:否 制造商:Atmel 處理器系列:SAMA5D31 核心:ARM Cortex A5 數(shù)據(jù)總線寬度:32 bit 最大時(shí)鐘頻率:536 MHz 程序存儲(chǔ)器大小:32 KB 數(shù)據(jù) RAM 大小:128 KB 接口類型:CAN, Ethernet, LIN, SPI,TWI, UART, USB 工作電源電壓:1.8 V to 3.3 V 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:FBGA-324 |
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