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參數資料
| 型號： | MC68EN360ZP25 |
| 廠商： | MOTOROLA INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | QUad Integrated Communications Controller Users Manual |
| 中文描述： | 32-BIT, 25 MHz, RISC MICROCONTROLLER, PBGA357 |
| 封裝： | BGA-357 |
| 文件頁數： | 556/962頁 |
| 文件大小： | 2817K |
| 代理商： | MC68EN360ZP25 |
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Serial Communication Controllers (SCCs)
7-232
MC68360 USER’S MANUAL
MOTOROLA
7.10.21.11 TRANSPARENT EVENT REGISTER (SCCE).
The SCCE is called the trans-
parent event register when the SCC is operating as a transparent controller. It is a 16-bit reg-
ister used to report events recognized by the transparent channel and to generate interrupts.
On recognition of an event, the transparent controller will set the corresponding bit in the
transparent event register. Interrupts generated by this register may be masked in the trans-
parent mask register.
The transparent event register is a memory-mapped register that may be read at any time.
A bit is reset by writing a one (writing a zero does not affect a bit’s value). More than one bit
may be reset at a time. All unmasked bits must be reset before the CP will negate the inter-
nal interrupt request signal. This register is cleared at reset.
Bits 15–13, 9–8, 6–5—Reserved
GLr—Glitch on Rx
A clock glitch was detected by this SCC on the receive clock.
GLt—Glitch on Tx
A clock glitch was detected by this SCC on the transmit clock.
DCC—DPLL CS Changed
The carrier sense status as generated by the DPLL has changed state. The real-time sta-
tus may be found in SCCS. This is not the CD pin status, which is reported elsewhere,
and is only valid when the DPLL is used.
GRA—Graceful Stop Complete
A graceful stop, which was initiated by the GRACEFUL STOP TRANSMIT command, is
now complete. This bit is set as soon the transmitter has finished transmitting any frame
that was in progress when the command was issued. It will be set immediately if no frame
was in progress when the command was issued.
TXE—Tx Error
An error (CTS lost or underrun) occurred on the transmitter channel.
RCH—Receive Character
A byte or long word has been received and written to the buffer. This depends on the set-
ting of the RFW bit in the GSMR.
BSY—Busy Condition
A byte/long-word was received and discarded due to lack of buffers. The receiver will re-
sume reception after an ENTER HUNT MODE command.
15
14
—
13
12
GLr
11
GLt
10
DCC
9
—
8
—
7
6
—
5
—
4
3
2
1
TX
0
GRA
TXE
RCH
BSY
RX
相關PDF資料 |
PDF描述 |
|---|---|
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| MC68MH360CRC25 | QUad Integrated Communications Controller Users Manual |
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| MC68MH360FE33 | QUad Integrated Communications Controller Users Manual |
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相關代理商/技術參數 |
參數描述 |
|---|---|
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| MC68EN360ZP25LR2 | 功能描述:IC MPU QUICC 32BIT 25MHZ 357PBGA RoHS:否 類別:集成電路 (IC) >> 嵌入式 - 微處理器 系列:M683xx 標準包裝:1 系列:MPC85xx 處理器類型:32-位 MPC85xx PowerQUICC III 特點:- 速度:1.2GHz 電壓:1.1V 安裝類型:表面貼裝 封裝/外殼:783-BBGA，FCBGA 供應商設備封裝:783-FCPBGA（29x29） 包裝:托盤 |
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